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參數(shù)資料
| 型號： | C8051F367-GM |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 52/288頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC 8051 MCU 32K FLASH 28-QFN |
| 產(chǎn)品培訓模塊： | Serial Communication Overview |
| 標準包裝： | 73 |
| 系列： | C8051F36x |
| 核心處理器： | 8051 |
| 芯體尺寸： | 8-位 |
| 速度： | 50MHz |
| 連通性： | SMBus（2 線/I²C），SPI，UART/USART |
| 外圍設備： | POR，PWM，溫度傳感器，WDT |
| 輸入/輸出數(shù)： | 25 |
| 程序存儲器容量： | 32KB（32K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 1K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 17x10b; D/A 1x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 28-VFQFN 裸露焊盤 |
| 包裝： | 托盤 |
| 配用： | 336-1410-ND - KIT DEV FOR C8051F360 FAMILY |
| 其它名稱： | 336-1649 |
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Rev. 1.0
145
C8051F360/1/2/3/4/5/6/7/8/9
14. Branch Target Cache
The C8051F36x device families incorporate a 32x4 byte branch target cache with a 4-byte prefetch
engine. Because the access time of the Flash memory is 40 ns, and the minimum instruction time is 10 ns
(C8051F360/1/2/3/4/5/6/7) or 20 ns (C8051F368/9), the branch target cache and prefetch engine are nec-
essary for full-speed code execution. Instructions are read from Flash memory four bytes at a time by the
prefetch engine, and given to the CIP-51 processor core to execute. When running linear code (code with-
out any jumps or branches), the prefetch engine alone allows instructions to be executed at full speed.
When a code branch occurs, a search is performed for the branch target (destination address) in the
cache. If the branch target information is found in the cache (called a “cache hit”), the instruction data is
read from the cache and immediately returned to the CIP-51 with no delay in code execution. If the branch
target is not found in the cache (called a “cache miss”), the processor may be stalled for up to four clock
cycles while the next set of four instructions is retrieved from Flash memory. Each time a cache miss
occurs, the requested instruction data is written to the cache if allowed by the current cache settings. A
data flow diagram of the interaction between the CIP-51 and the Branch Target Cache and Prefetch
Engine is shown in Figure 14.1.
Flash
Memory
Branch Target
Cache
Prefetch
Engine
Instruction
Data
CIP-51
Instruction Address
Figure 14.1. Branch Target Cache Data Flow
14.1. Cache and Prefetch Operation
The branch target cache maintains two sets of memory locations: “slots” and “tags”. A slot is where the
cached instruction data from Flash is stored. Each slot holds four consecutive code bytes. A tag contains
the 13 most significant bits of the corresponding Flash address for each four-byte slot. Thus, instruction
data is always cached along four-byte boundaries in code space. A tag also contains a “valid bit”, which
indicates whether a cache location contains valid instruction data. A special cache location (called the lin-
ear tag and slot), is reserved for use by the prefetch engine. The cache organization is shown in
Figure 14.2. Each time a Flash read is requested, the address is compared with all valid cache tag loca-
tions (including the linear tag). If any of the tag locations match the requested address, the data from that
slot is immediately provided to the CIP-51. If the requested address matches a location that is currently
being read by the prefetch engine, the CIP-51 will be stalled until the read is complete. If a match is not
found, the current prefetch operation is abandoned, and a new prefetch operation is initiated for the
requested instruction data. When the prefetch operation is finished, the CIP-51 begins executing the
instructions that were retrieved, and the prefetch engine begins reading the next four-byte word from Flash
memory. If the newly-fetched data also meets the criteria necessary to be cached, it will be written to the
cache in the slot indicated by the current replacement algorithm.
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PDF描述 |
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參數(shù)描述 |
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| C8051F367-GM2 | 制造商:SILABS 制造商全稱:SILABS 功能描述:Mixed Signal ISP Flash MCU Family |
| C8051F367-GMR | 功能描述:8位微控制器 -MCU 32KB 50MIPS 10ADC 10 DAC 28Pin MCU RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT |
| C8051F368 | 制造商:SILABS 制造商全稱:SILABS 功能描述:Mixed Signal ISP Flash MCU Family |
| C8051F368-C-GQ | 功能描述:8051 C8051F36x Microcontroller IC 8-Bit 50MHz 16KB (16K x 8) FLASH 32-LQFP (7x7) 制造商:silicon labs 系列:C8051F36x 包裝:托盤 零件狀態(tài):Not For New Designs 核心處理器:8051 核心尺寸:8-位 速度:50MHz 連接性:SMBus（2 線/I2C），SPI，UART/USART 外設:POR，PWM，溫度傳感器，WDT I/O 數(shù):29 程序存儲容量:16KB（16K x 8） 程序存儲器類型:閃存 EEPROM 容量:- RAM 容量:1K x 8 電壓 - 電源（Vcc/Vdd）:2.7 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 21x10b；D/A 1x10b 振蕩器類型:內(nèi)部 工作溫度:-40°C ~ 85°C（TA） 封裝/外殼:32-LQFP 供應商器件封裝:32-LQFP（7x7） 標準包裝:250 |
| C8051F368-C-GQR | 功能描述:8051 C8051F36x Microcontroller IC 8-Bit 50MHz 16KB (16K x 8) FLASH 32-LQFP (7x7) 制造商:silicon labs 系列:C8051F36x 包裝:帶卷（TR） 零件狀態(tài):Not For New Designs 核心處理器:8051 核心尺寸:8-位 速度:50MHz 連接性:SMBus（2 線/I2C），SPI，UART/USART 外設:POR，PWM，溫度傳感器，WDT I/O 數(shù):29 程序存儲容量:16KB（16K x 8） 程序存儲器類型:閃存 EEPROM 容量:- RAM 容量:1K x 8 電壓 - 電源（Vcc/Vdd）:2.7 V ~ 3.6 V 數(shù)據(jù)轉(zhuǎn)換器:A/D 21x10b；D/A 1x10b 振蕩器類型:內(nèi)部 工作溫度:-40°C ~ 85°C（TA） 封裝/外殼:32-LQFP 供應商器件封裝:32-LQFP（7x7） 標準包裝:500 |
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