ExtClk < fclk_I/O
參數(shù)資料
型號： ATTINY43U-SU
廠商： Atmel
文件頁數(shù)： 4/158頁
文件大?。?/td> 0K
描述： MCU AVR 4K FLASH 8MHZ 20-SOIC
產(chǎn)品培訓模塊： ATtiny43U Overview
MCU Product Line Introduction
tinyAVR Introduction
標準包裝： 37
系列： AVR® ATtiny
核心處理器： AVR
芯體尺寸： 8-位
速度： 8MHz
連通性： USI
外圍設備： 欠壓檢測/復位，POR，PWM，溫度傳感器，WDT
輸入/輸出數(shù)： 16
程序存儲器容量： 4KB（2K x 16）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 64 x 8
RAM 容量： 256 x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 5.5 V
數(shù)據(jù)轉換器： A/D 4x10b
振蕩器型： 內部
工作溫度： -40°C ~ 85°C
封裝/外殼： 20-SOIC（0.295"，7.50mm 寬）
包裝： 管件
產(chǎn)品目錄頁面： 613 (CN2011-ZH PDF)
配用： ATSTK600-TINYX3U-ND - STK600 SOCKET/ADAPTER TINYX3U
101
8048C–AVR–02/12
ATtiny43U
tem clock frequency (f
ExtClk < fclk_I/O/2) given a 50/50% duty cycle. Since the edge detector uses
sampling, the maximum frequency of an external clock it can detect is half the sampling fre-
quency (Nyquist sampling theorem). However, due to variation of the system clock frequency
and duty cycle caused by Oscillator source (crystal, resonator, and capacitors) tolerances, it is
recommended that maximum frequency of an external clock source is less than f
clk_I/O/2.5.
An external clock source can not be prescaled.
Figure 13-2. Prescaler for Timer/Countern
Note:
1. The synchronization logic on the input pins (
Tn) is shown in Figure 13-1 on page 100.
13.3
Register Description
13.3.1
GTCCR – General Timer/Counter Control Register
Bit 7 – TSM: Timer/Counter Synchronization Mode
Writing the TSM bit to one activates the Timer/Counter Synchronization mode. In this mode, the
value that is written to the PSR10 bit is kept, hence keeping the Prescaler Reset signal asserted.
This ensures that the Timer/Counter is halted and can be configured without the risk of advanc-
ing during configuration. When the TSM bit is written to zero, the PSR10 bit is cleared by
hardware, and the Timer/Counter start counting.
Bit 0 – PSR10: Prescaler Reset Timer/Counter
When this bit is one, the Timer/Counter prescaler will be reset. This bit is normally cleared imme-
diately by hardware, except if the TSM bit is set.
PSR10
Clear
clk
Tn
Tn
clk
I/O
Synchronization
CSn0
0
CSn1
CSn2
TIMER/COUNTERn CLOCK SOURCE
Bit
7
6
5
4
3
2
1
0
TSM
–
PSR10
GTCCR
Read/Write
R/W
R
R/W
Initial Value
0
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PDF描述
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