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參數(shù)資料
| 型號： | ATMEGA48-15MT |
| 廠商： | Atmel |
| 文件頁數(shù)： | 66/240頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU AVR 4K FLASH 15MHZ 32-QFN |
| 產(chǎn)品培訓模塊： | megaAVR Introduction |
| 標準包裝： | 1 |
| 系列： | AVR® ATmega |
| 核心處理器： | AVR |
| 芯體尺寸： | 8-位 |
| 速度： | 16MHz |
| 連通性： | I²C，SPI，UART/USART |
| 外圍設備： | 欠壓檢測/復位，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 23 |
| 程序存儲器容量： | 4KB（2K x 16） |
| 程序存儲器類型： | 閃存 |
| EEPROM 大小： | 256 x 8 |
| RAM 容量： | 512 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 32-VFQFN 裸露焊盤 |
| 包裝： | 剪切帶 (CT) |
| 其它名稱： | ATMEGA48-15MTCT |
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PIC16LF1902/3
DS41455B-page 158
Preliminary
2011 Microchip Technology Inc.
REGISTER 18-7:
LCDRL: LCD REFERENCE LADDER CONTROL REGISTERS
R/W-0/0
U-0
R/W-0/0
LRLAP<1:0>
LRLBP<1:0>
—
LRLAT<2:0>
bit 7
bit 0
Legend:
R = Readable bit
W = Writable bit
U = Unimplemented bit, read as ‘0’
u = Bit is unchanged
x = Bit is unknown
-n/n = Value at POR and BOR/Value at all other Resets
‘1’ = Bit is set
‘0’ = Bit is cleared
bit 7-6
LRLAP<1:0>:
LCD Reference Ladder A Time Power Control bits
During Time interval A (Refer toFigure 18-4):
00
= Internal LCD Reference Ladder is powered down and unconnected
01
= Internal LCD Reference Ladder is powered in Low-Power mode
10
= Internal LCD Reference Ladder is powered in Medium-Power mode
11
= Internal LCD Reference Ladder is powered in High-Power mode
bit 5-4
LRLBP<1:0>:
LCD Reference Ladder B Time Power Control bits
During Time interval B (Refer to Figure 18-4):
00
= Internal LCD Reference Ladder is powered down and unconnected
01
= Internal LCD Reference Ladder is powered in Low-Power mode
10
= Internal LCD Reference Ladder is powered in Medium-Power mode
11
= Internal LCD Reference Ladder is powered in High-Power mode
bit 3
Unimplemented:
Read as ‘0’
bit 2-0
LRLAT<2:0>:
LCD Reference Ladder A Time Interval Control bits
Sets the number of 32 kHz clocks that the A Time Interval Power mode is active
For type A waveforms (WFT = 0):
000
= Internal LCD Reference Ladder is always in ‘B’ Power mode
001
= Internal LCD Reference Ladder is in ‘A’ Power mode for 1 clock and ‘B’ Power mode for 15 clocks
010
= Internal LCD Reference Ladder is in ‘A’ Power mode for 2 clocks and ‘B’ Power mode for 14 clocks
011
= Internal LCD Reference Ladder is in ‘A’ Power mode for 3 clocks and ‘B’ Power mode for 13 clocks
100
= Internal LCD Reference Ladder is in ‘A’ Power mode for 4 clocks and ‘B’ Power mode for 12 clocks
101
= Internal LCD Reference Ladder is in ‘A’ Power mode for 5 clocks and ‘B’ Power mode for 11 clocks
110
= Internal LCD Reference Ladder is in ‘A’ Power mode for 6 clocks and ‘B’ Power mode for 10 clocks
111
= Internal LCD Reference Ladder is in ‘A’ Power mode for 7 clocks and ‘B’ Power mode for 9 clocks
For type B waveforms (WFT = 1):
000
= Internal LCD Reference Ladder is always in ‘B’ Power mode.
001
= Internal LCD Reference Ladder is in ‘A’ Power mode for 1 clock and ‘B’ Power mode for 31 clocks
010
= Internal LCD Reference Ladder is in ‘A’ Power mode for 2 clocks and ‘B’ Power mode for 30 clocks
011
= Internal LCD Reference Ladder is in ‘A’ Power mode for 3 clocks and ‘B’ Power mode for 29 clocks
100
= Internal LCD Reference Ladder is in ‘A’ Power mode for 4 clocks and ‘B’ Power mode for 28 clocks
101
= Internal LCD Reference Ladder is in ‘A’ Power mode for 5 clocks and ‘B’ Power mode for 27 clocks
110
= Internal LCD Reference Ladder is in ‘A’ Power mode for 6 clocks and ‘B’ Power mode for 26 clocks
111
= Internal LCD Reference Ladder is in ‘A’ Power mode for 7 clocks and ‘B’ Power mode for 25 clocks
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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