The I2
參數(shù)資料
型號(hào)： ATMEGA325V-8MUR
廠商： Atmel
文件頁數(shù)： 20/85頁
文件大?。?/td> 0K
描述： MCU AVR 32K FLASH 8MHZ 64QFN
產(chǎn)品培訓(xùn)模塊： megaAVR Introduction
標(biāo)準(zhǔn)包裝： 4,000
系列： AVR® ATmega
核心處理器： AVR
芯體尺寸： 8-位
速度： 8MHz
連通性： SPI，UART/USART，USI
外圍設(shè)備： 欠壓檢測(cè)/復(fù)位，POR，PWM，WDT
輸入/輸出數(shù)： 54
程序存儲(chǔ)器容量： 32KB（16K x 16）
程序存儲(chǔ)器類型： 閃存
EEPROM 大小： 1K x 8
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 1.8 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-VFQFN 裸露焊盤
包裝： 帶卷 (TR)
其它名稱： ATMEGA325V-8MUR-ND
PIC16(L)F1824/1828
DS41419C-page 244
Preliminary
2010-2011 Microchip Technology Inc.
The I2C interface supports the following modes and
features:
Master mode
Slave mode
Byte NACKing (Slave mode)
Limited multi-master support
7-bit and 10-bit addressing
Start and Stop interrupts
Interrupt masking
Clock stretching
Bus collision detection
General call address matching
Address masking
Address Hold and Data Hold modes
Selectable SDA hold times
Figure 25-2 is a block diagram of the I2C interface mod-
ule in Master mode. Figure 25-3 is a diagram of the I2C
interface module in Slave mode.
FIGURE 25-2:
MSSP1 BLOCK DIAGRAM (I2C MASTER MODE)
Read
Write
SSP1SR
Start bit, Stop bit,
Start bit detect,
SSP1BUF
Internal
data bus
Set/Reset: S, P, SSP1STAT, WCOL, SSPOV
Shift
Clock
MSb
LSb
SDA
Acknowledge
Generate (SSP1CON2)
Stop bit detect
Write collision detect
Clock arbitration
State counter for
end of XMIT/RCV
SCL
SCL in
Bus Collision
SDA in
Re
ce
iv
eEn
a
ble
(RCEN)
Clo
ck
Cn
tl
C
lo
ck
a
rbi
tr
at
e/B
C
OL
de
tect
(H
old
of
fclock
sou
rce
)
[SSPM 3:0]
Baud rate
Reset SEN, PEN (SSP1CON2)
generator
(SSP1ADD)
Address Match detect
Set SSP1IF, BCL1IF
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PDF描述
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