參數(shù)資料
型號： AT90CAN64-16AUR
廠商： Atmel
文件頁數(shù)： 129/388頁
文件大?。?/td> 0K
描述： MCU AVR 64K FLASH 16MHZ 64TQFP
產(chǎn)品培訓模塊： MCU Product Line Introduction
標準包裝： 1,000
系列： AVR® 90CAN
核心處理器： AVR
芯體尺寸： 8-位
速度： 16MHz
連通性： CAN，EBI/EMI，I²C，SPI，UART/USART
外圍設備： 欠壓檢測/復位，POR，PWM，WDT
輸入/輸出數(shù)： 53
程序存儲器容量： 64KB（64K x 8）
程序存儲器類型： 閃存
EEPROM 大?。?/td> 2K x 8
RAM 容量： 4K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 64-LQFP
包裝： 帶卷 (TR)
配用： ATSTK600-RC09-ND - STK600 ROUTING CARD AVR
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214
7679H–CAN–08/08
AT90CAN32/64/128
Bits 1.0 – TWPS: TWI Prescaler Bits
These bits can be read and written, and control the bit rate prescaler.
To calculate bit rates, see “Bit Rate Generator Unit” on page 210. The value of TWPS1.0 is used
in the equation.
18.6.4
TWI Data Register – TWDR
In Transmit mode, TWDR contains the next byte to be transmitted. In receive mode, the TWDR
contains the last byte received. It is writable while the TWI is not in the process of shifting a byte.
This occurs when the TWI interrupt flag (TWINT) is set by hardware. Note that the Data Register
cannot be initialized by the user before the first interrupt occurs. The data in TWDR remains sta-
ble as long as TWINT is set. While data is shifted out, data on the bus is simultaneously shifted
in. TWDR always contains the last byte present on the bus, except after a wake up from a sleep
mode by the TWI interrupt. In this case, the contents of TWDR is undefined. In the case of a lost
bus arbitration, no data is lost in the transition from Master to Slave. Handling of the ACK bit is
controlled automatically by the TWI logic, the CPU cannot access the ACK bit directly.
Bits 7.0 – TWD: TWI Data Register
These eight bits constitute the next data byte to be transmitted, or the latest data byte received
on the TWI Serial Bus.
18.6.5
TWI (Slave) Address Register – TWAR
Bits 7.1 – TWA: TWI (Slave) Address Register
These seven bits constitute the slave address of the TWI unit. The TWAR should be loaded with
the 7-bit slave address to which the TWI will respond when programmed as a slave transmitter
or receiver, and not needed in the master modes. In multimaster systems, TWAR must be set in
masters which can be addressed as slaves by other masters.
Bit 0 – TWGCE: TWI General Call Recognition Enable Bit
Table 18-2.
TWI Bit Rate Prescaler
TWPS1
TWPS0
Prescaler Value
00
1
01
4
10
16
11
64
Bit
765
4321
0
TWD7
TWD6
TWD5
TWD4
TWD3
TWD2
TWD1
TWD0
TWDR
Read/Write
R/W
Initial Value
111
1111
1
Bit
765
4321
0
TWA6
TWA5
TWA4
TWA3
TWA2
TWA1
TWA0
TWGCE
TWAR
Read/Write
R/W
Initial Value
111
1111
0
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PDF描述
AT90LS2343-1SI IC MCU 2K FLASH 1MHZ IND 8-SOIC
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參數(shù)描述
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AT90CAN64-16MUR 功能描述:8位微控制器 -MCU 64 KB FLASH - 16MHz RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT
AT90CAN64-IL 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Microcontroller with 32/64k Bytes of ISP Flash and CAN Controller
AT90CAN64-UL 制造商:ATMEL 制造商全稱:ATMEL Corporation 功能描述:Microcontroller with 32/64k Bytes of ISP Flash and CAN Controller
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