參數(shù)資料
型號: AT89S4051-24PU
廠商: Atmel
文件頁數(shù): 32/46頁
文件大小: 0K
描述: MCU 8051 4K FLASH 24MHZ 20-PDIP
產(chǎn)品培訓(xùn)模塊: MCU Product Line Introduction
標(biāo)準(zhǔn)包裝: 18
系列: 89S
核心處理器: 8051
芯體尺寸: 8-位
速度: 24MHz
連通性: UART/USART
外圍設(shè)備: 欠壓檢測/復(fù)位,POR,PWM
輸入/輸出數(shù): 15
程序存儲器容量: 4KB(4K x 8)
程序存儲器類型: 閃存
RAM 容量: 256 x 8
電壓 - 電源 (Vcc/Vdd): 2.7 V ~ 5.5 V
振蕩器型: 內(nèi)部
工作溫度: -40°C ~ 85°C
封裝/外殼: 20-DIP(0.300",7.62mm)
包裝: 管件
38
3390E–MICRO–6/08
AT89S2051/S4051
45. Shift Register Mode Timing Waveforms
46. AC Testing Input/Output Waveforms(1)
Note:
1. AC Inputs during testing are driven at V
CC - 0.5V for a logic 1 and 0.45V for a logic 0. Timing
measurements are made at VIH min. for a logic 1 and VIL max. for a logic 0.
47. Float Waveforms(1)
Note:
1. For timing purposes, a port pin is no longer floating when a 100 mV change from load voltage
occurs. A port pin begins to float when 100 mV change from the loaded VOH/VOL level occurs.
44. Serial Port Timing: Shift Register Mode Test Conditions
The values in this table are valid for V
CC = 2.7V to 5.5V and Load Capacitance = 80 pF.
Symbol
Parameter
Variable
Units
Min
Max
tXLXL
Serial Port Clock Cycle Time
12tCLCL -15
s
t
QVXH
Output Data Setup to Clock Rising Edge
10t
CLCL -15
ns
tXHQX
Output Data Hold after Clock Rising Edge
2tCLCL -15
ns
tXHDX
Input Data Hold after Clock Rising Edge
tCLCL
ns
t
XHDV
Input Data Valid to Clock Rising Edge
0
ns
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PDF描述
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參數(shù)描述
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