參數(shù)資料
型號(hào)： AS8530A-ASOT-500
廠商： ams
文件頁數(shù)： 2/33頁
文件大小： 0K
描述： IC SYSTEM BASIS CHIP 8-SOIC
標(biāo)準(zhǔn)包裝： 500
系列： *
Revision 1.1
9 - 32
AS8530
Datasheet - Electrical Character i s t ics
6.5.2 AC Electrical Characteristics
LIN Driver, Bus load conditions (CBUS ; RBUS): 1nF; 1k
Ω / 6,8nF; 660Ω / 10nF; 500Ω
Note:
Sleep-mode to Normal mode transition is identical to the Power-ON sequence after the remote wakeup event on LIN bus. The
transition time will include the tRes (RESET time) and start-up time for the LDO.
Symbol
Conditions
Min
Typ
Max
Units
D1
(worst case 20Kbps transmission)
Vth_rec(max) = 0.744 x VSUP;
Vth_dom(max) = 0.581 x VSUP;
VSUP = 6.0V to 18V; tbit = 50μs;
D1 = tbus_rec(min) / (2 x tbit)
0.369
D2
(worst case 20kbps transmission)
Vth_rec (min) = 0.422 x VSUP;
Vth_dom (min) = 0.284 x VSUP;
VSUP = 6V to 18V; tbit = 50μs;
D2 = tbus_rec(max) / (2 x tbit)
0.581
D3
(worst case 10.4kbps transmission)
Vth_rec (max) = 0.778 x VSUP;
Vth_dom (max) = 0.616 x VSUP;
VSUP = 6.0V to 18V; tbit = 96μs;
D3 = tbus_rec(min) / (2 x tbit)
0.417
D4
(worst case 10.4kbps transmission)
Vth_rec (min) = 0.389 x VSUP;
Vth_dom (min) = 0.251 x VSUP;
VSUP = 6V to18V; tbit = 96μs;
D4 = tbus_rec(max) / (2 x tbit)
0.59
tdLR
VCC = 5V;
Propagation delay bus dominant to RX LOW
6s
tdHR
VCC = 5V;
Propagation delay bus dominant to RX HIGH
6s
tRS
Receiver Delay symmetry
-2
2
s
twake
Wake-up delay time
30
150
s
tsln
Transition from standby mode to normal mode
(clock frequency is 128kHz ± 25%)
4
Clock cycles
tnsl
Transition from normal mode to standby mode
(clock frequency is 128kHz ± 25%)
6
Clock cycles
trec_deb
Receiver De-bounce time
1
3
s
Cint
Guaranteed by design
220
250
pF
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