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參數(shù)資料
| 型號： | APA150-BGG456 |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 94/178頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA PROASIC+ 150K 456-PBGA |
| 標準包裝： | 24 |
| 系列： | ProASICPLUS |
| RAM 位總計： | 36864 |
| 輸入/輸出數(shù)： | 242 |
| 門數(shù)： | 150000 |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 456-BBGA |
| 供應商設備封裝： | 456-PBGA（35x35） |
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ProASICPLUS Flash Family FPGAs
2- 12
v5.9
Note: When a signal from an I/O tile is connected to the core, it cannot be connected to the global MUX at the same time.
Figure 2-12 Input Connectors to ProASICPLUS Clock Conditioning Circuitry
Table 2-7
Clock-Conditioning Circuitry MUX Settings
MUX
Datapath
Comments
FBSEL
1
Internal Feedback
2
Internal Feedback and Advance Clock Using FBDLY
–0.25 to –4 ns in 0.25 ns increments
3
External Feedback (EXTFB)
XDLYSEL
0
Feedback Unchanged
1
Deskew feedback by advancing clock by system delay
Fixed delay of –2.95 ns
OBMUX
GLB
0
Primary bypass, no divider
1
Primary bypass, use divider
2
Delay Clock Using FBDLY
+0.25 to +4 ns in 0.25 ns increments
4
Phase Shift Clock by 0°
5
Reserved
6
Phase Shift Clock by +180°
7
Reserved
OAMUX
GLA
0
Secondary bypass, no divider
1
Secondary bypass, use divider
2
Delay Clock Using FBDLY
+0.25 to +4 ns in 0.25 ns increments
3
Phase Shift Clock by 0°
Configuration Tile
PECL Pad Cell
GLMX
GL
Std. Pad Cell
GL
NPECL
PPECL
CORE
Package Pins
Physical I/O
Buffers
Global MUX
External
Feedback
Global MUX B
OUT
Global MUX A
OUT
Legend
Physical Pin
DATA Signals to the Core
DATA Signals to the PLL Block
DATA Signals to the Global MUX
Control Signals to the Global MUX
相關PDF資料 |
PDF描述 |
|---|---|
| ABM43DTMS | CONN EDGECARD 86POS R/A .156 SLD |
| APA150-PQG208A | IC FPGA PROASIC+ 150K 208-PQFP |
| ABM43DTBS | CONN EDGECARD 86POS R/A .156 SLD |
| APA150-PQ208A | IC FPGA PROASIC+ 150K 208-PQFP |
| ABM43DTAS | CONN EDGECARD 86POS R/A .156 SLD |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| APA150-BGG456I | 功能描述:IC FPGA PROASIC+ 150K 456-PBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場可編程門陣列） 系列:ProASICPLUS 標準包裝:40 系列:SX-A LAB/CLB數(shù):6036 邏輯元件/單元數(shù):- RAM 位總計:- 輸入/輸出數(shù):360 門數(shù):108000 電源電壓:2.25 V ~ 5.25 V 安裝類型:表面貼裝 工作溫度:0°C ~ 70°C 封裝/外殼:484-BGA 供應商設備封裝:484-FPBGA（27X27） |
| APA150-BGGB | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
| APA150-BGGES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
| APA150-BGGI | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
| APA150-BGGM | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ProASIC Flash Family FPGAs |
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