參數(shù)資料
型號: ADUM1210BRZ-RL7
廠商: ANALOG DEVICES INC
元件分類: 其它接口
英文描述: Dual-Channel Digital Isolator
中文描述: SPECIALTY INTERFACE CIRCUIT, PDSO8
封裝: ROHS COMPLIANT, MS-012AA, SOIC-8
文件頁數(shù): 3/16頁
文件大?。?/td> 184K
代理商: ADUM1210BRZ-RL7
ADuM1210
SPECIFICATIONS
ELECTRICAL CHARACTERISTICS—5 V OPERATION
All voltages are relative to their respective ground. 4.5 V ≤ V
DD1
≤ 5.5 V, 4.5 V ≤ V
DD2
≤ 5.5 V. All minimum/maximum specifications
apply over the entire recommended operating range, unless otherwise noted. All typical specifications are at T
A
= 25°C, V
DD1
= V
DD2
= 5 V.
Table 1.
Parameter
Symbol
Min
DC SPECIFICATIONS
Input Supply Current, per Channel, Quiescent
I
DDI (Q)
Output Supply Current, per Channel, Quiescent
I
DDO (Q)
Total Supply Current, Two Channels
1
DC to 2 Mbps
V
DD1
Supply Current
I
DD1 (Q)
V
DD2
Supply Current
I
DD2 (Q)
10 Mbps
V
DD1
Supply Current
I
DD1 (10)
V
DD2
Supply Current
I
DD2 (10)
Input Currents
I
IA
, I
IB
10
Logic High Input Threshold
V
IH
0.7 V
DD1
,
V
DD2
Logic Low Input Threshold
V
IL
Rev. A | Page 3 of 16
Typ
0.50
0.19
1.1
0.5
4.3
1.3
+0.01
Max
0.60
0.25
1.4
0.8
5.5
2.0
+10
Unit
mA
mA
mA
mA
mA
mA
μA
V
Test Conditions
DC to 1 MHz logic signal freq.
DC to 1 MHz logic signal freq.
5 MHz logic signal freq.
5 MHz logic signal freq.
0 ≤ V
IA
, V
IB
≤ V
DD1
or V
DD2
0.3 V
DD1
,
V
DD2
V
Logic High Output Voltages
V
OAH
V
DD1
/
V
DD2
0.1
V
DD1
/
V
DD2
0.5
10
20
5.0
V
I
Ox
= 20 μA, V
Ix
= V
IxH
V
OBH
4.8
V
I
Ox
= 4 mA, V
Ix
= V
IxH
Logic Low Output Voltages
V
OAL
V
OBL
PW
t
PHL
, t
PLH
PWD
t
PSK
t
PSKCD
0.0
0.04
0.2
5
0.1
0.1
0.4
100
50
3
15
3
V
V
V
ns
Mbps
ns
ns
ps/°C
ns
ns
I
Ox
= 20 μA, V
Ix
= V
IxL
I
Ox
= 400 μA, V
Ix
= V
IxL
I
Ox
= 4 mA, V
Ix
= V
IxL
C
L
= 15 pF, CMOS signal levels
C
L
= 15 pF, CMOS signal levels
C
L
= 15 pF, CMOS signal levels
C
L
= 15 pF, CMOS signal levels
C
L
= 15 pF, CMOS signal levels
C
L
= 15 pF, CMOS signal levels
C
L
= 15 pF, CMOS signal levels
SWITCHING SPECIFICATIONS
Minimum Pulse Width
2
Maximum Data Rate
3
Propagation Delay
4
Pulse-Width Distortion, |t
PLH
t
PHL
|
4
Change vs. Temperature
Propagation Delay Skew
5
Channel-to-Channel Matching, Codirectional
Channels
6
Channel-to-Channel Matching, Opposing-
Directional Channels
6
Output Rise/Fall Time (10% to 90%)
Common-Mode Transient Immunity at
Logic High Output
7
Common-Mode Transient Immunity at
Logic Low Output
7
Refresh Rate
Input Dynamic Supply Current, per Channel
8
Output Dynamic Supply Current, per Channel
8
t
PSKOD
15
ns
C
L
= 15 pF, CMOS signal levels
t
R
/t
F
|CM
H
|
25
2.5
35
ns
kV/μs
C
L
= 15 pF, CMOS signal levels
V
Ix
= V
DD1
, V
DD2
, V
CM
= 1000 V,
transient magnitude = 800 V
V
Ix
= 0 V, V
CM
= 1000 V,
transient magnitude = 800 V
|CM
L
|
25
35
kV/μs
f
r
I
DDI (D)
I
DDO (D)
1.2
0.19
0.05
Mbps
mA/Mbps
mA/Mbps
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參數(shù)描述
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