參數資料
型號： ADSP-2187NBCA-320
廠商： Analog Devices Inc
文件頁數： 32/48頁
文件大?。?/td> 0K
描述： IC DSP 16BIT 80MHZ 144CSPBGA
標準包裝： 1
系列： ADSP-21xx
類型： 定點
接口： 主機接口，串行端口
時鐘速率： 80MHz
非易失內存： 外部
芯片上RAM： 160kB
電壓 - 輸入/輸出： 1.8V，2.5V，3.3V
電壓 - 核心： 1.90V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 144-LFBGA，CSPBGA
供應商設備封裝： 144-CSBGA（10x10）
包裝： 托盤
Rev. A
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August 2006
ADSP-218xN
IDMA Read, Short Read Cycle
Table 25. IDMA Read, Short Read Cycle
Parameter
1, 2
Min
Max
Unit
Timing Requirements:
tIKR
IACK Low Before Start of Read3
0ns
tIRP1
Duration of Read (DM/PM1)4
10
2tCK – 5
ns
tIRP2
Duration of Read (PM2)5
10
tCK – 5
ns
Switching Characteristics:
tIKHR
IACK High After Start of Read
10
ns
tIKDH
IAD15 – 0 Data Hold After End of Read
6
0ns
tIKDD
IAD15 – 0 Data Disabled After End of Read6
10
ns
tIRDE
IAD15 – 0 Previous Data Enabled After Start of Read
0
ns
tIRDV
IAD15 – 0 Previous Data Valid After Start of Read
10
ns
1 Short Read Only must be disabled in the IDMA overlay memory mapped register. This mode is disabled by clearing (=0) Bit 14 of the IDMA overlay register, and is
disabled by default upon reset.
2 Consider using the Short Read Only mode, instead, because Short Read mode is not applicable at high clock frequencies.
3 Start of Read = IS Low and IRD Low.
4 DM Read or first half of PM Read.
5 Second half of PM Read.
6 End of Read = IS High or IRD High.
Figure 36. IDMA Read, Short Read Cycle
tIRP
tIKR
PREVIOUS
DATA
tIKHR
tIRDV
tIKDD
tIRDE
tIKDH
IAD15–0
IACK
IS
IRD
相關PDF資料
PDF描述
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