參數(shù)資料
型號： ADSP-2181BST-115
廠商： ANALOG DEVICES INC
元件分類： 數(shù)字信號處理
英文描述： DSP Microcomputer
中文描述： 24-BIT, 14.4 MHz, OTHER DSP, PQFP128
封裝： METRIC, PLASTIC, TQFP-128
文件頁數(shù)： 15/32頁
文件大?。?/td> 290K
代理商： ADSP-2181BST-115
ADSP-2181
–15–
REV. D
Parameter
Min
Max
Unit
Interrupts and Flag
Timing Requirements
:
t
IFS
t
IFH
IRQx
, FI, or PFx Setup before CLK OUT Low
1, 2, 3, 4
IRQx
, FI, or PFx Hold after CLK OUT High
1, 2, 3, 4
0.25t
CK
+ 15
0.25t
CK
ns
ns
Switching Characteristics:
t
FOH
t
FOD
Flag Output Hold after CLK OUT Low
5
Flag Output Delay from CLK OUT Low
5
0.5t
CK
– 7
ns
ns
0.5t
CK
+ 5
NOT ES
1
If
IRQx
and FI inputs meet t
and t
setup/hold requirements, they will be recognized during the current clock cycle; otherwise the signals will be recognized on
the following cycle. (Refer to “Interrupt Controller Operation” in the Program Control chapter of the User’s Manual for further information on interrupt servicing.)
2
Edge-sensitive interrupts require pulsewidths greater than 10 ns; level-sensitive interrupts must be held low until serviced.
3
IRQx
=
IRQ0
,
IRQ1
,
IRQ2
, I
RQL0
,
IRQL1
,
IRQE
.
4
PFx = PF0, PF1, PF2, PF3, PF4, PF5, PF6, PF7.
5
Flag outputs = PFx, FL0, FL1, FL2, Flag_out4.
t
FOD
t
FOH
t
IFH
t
IFS
CLKOUT
FLAG
OUTPUTS
IRQ
x
FI
PFx
Figure 9. Interrupts and Flags
相關PDF資料
PDF描述
ADSP-2181BST-133 DSP Microcomputer
ADSP2181 DSP Microcomputer
ADSP-2183KST-115 DSP Microcomputer
ADSP-2183KST-133 DSP Microcomputer
ADSP-2183KST-160 DSP Microcomputer
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參數(shù)描述
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