fIN Input Frequency MHz 70 75 80 85 90 95 100 0 25 50 75 100 125 150 175 200 S" />
參數資料
型號： ADS62P45IRGCRG4
廠商： Texas Instruments
文件頁數： 40/78頁
文件大?。?/td> 0K
描述： IC ADC 14BIT SER/PAR 125M 64VQFN
產品培訓模塊： Data Converter Basics
標準包裝： 2,000
位數： 14
采樣率（每秒）： 125M
數據接口： 串行，并聯
轉換器數目： 2
電壓電源： 模擬和數字
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-VFQFN 裸露焊盤
供應商設備封裝： 64-VQFN 裸露焊盤（9x9）
包裝： 帶卷 (TR)
輸入數目和類型： 2 個差分，單極
fIN Input Frequency MHz
70
75
80
85
90
95
100
0
25
50
75
100
125
150
175
200
SFDR
dBc
G075
Gain = 0 dB
Gain = 3.5 dB
fIN Input Frequency MHz
66
68
70
72
74
76
78
80
0
25
50
75
100
125
150
175
200
SNR
dBFS
G076
Gain = 0 dB
Gain = 3.5 dB
f Frequency MHz
100
90
80
70
60
50
40
30
20
10
0
25
50
75
100
125
150
175
200
CMRR
dBc
G077
fS Sampling Frequency MSPS
0.0
0.1
0.2
0.3
0.4
0.5
0.6
0.7
0.8
0.9
1.0
0
25
50
75
100
125
P
D
Power
Dissipation
W
G078
LVDS
CMOS
fIN = 2.5 MHz
CL = 5 pF
SLAS561C
– JULY 2007 – REVISED FEBRUARY 2012
TYPICAL CHARACTERISTICS
– LOW SAMPLING FREQUENCIES
All plots are at 25
°C, AVDD = DRVDD = 3.3 V, sine wave input clock, 1.5 VPP differential clock amplitude, 50% clock duty
cycle,
–1 dBFS differential analog input, internal reference mode, 0 dB gain, CMOS output interface (unless otherwise noted)
FS = 25 MSPS
SFDR vs INPUT FREQUENCY
SNR vs INPUT FREQUENCY
Figure 77.
Figure 78.
COMMON PLOTS
POWER DISSIPATION
vs
COMMON-MODE REJECTION RATIO vs FREQUENCY
SAMPLING FREQUENCY (DDR LVDS and CMOS)
Figure 79.
Figure 80.
Copyright
2007–2012, Texas Instruments Incorporated
45
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PDF描述
VI-2NN-IW-F2 CONVERTER MOD DC/DC 18.5V 100W
MS27474E16B35B CONN HSG RCPT 55POS JAMNUT SCKT
VI-2NM-IW-F4 CONVERTER MOD DC/DC 10V 100W
D38999/26WD5PNLC CONN HSG PLUG 5POS STRGHT PINS
VI-2NM-IW-F1 CONVERTER MOD DC/DC 10V 100W
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參數描述
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