TIMING CHARACTERISTICS1, 2 Parameter Limit at T
參數(shù)資料
型號(hào)： ADG731BCPZ-REEL
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 12/16頁(yè)
文件大?。?/td> 0K
描述： IC MULTIPLEXER 32X1 48LFCSP
產(chǎn)品培訓(xùn)模塊： Switch Fundamentals
標(biāo)準(zhǔn)包裝： 2,500
功能： 多路復(fù)用器
電路： 1 x 32:1
導(dǎo)通狀態(tài)電阻： 5.5 歐姆
電壓電源： 單/雙電源
電壓 - 電源，單路/雙路(±)： 1.8 V ~ 5.5 V，±2.5 V
電流 - 電源： 10µA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 48-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 48-LFCSP
包裝： 帶卷 (TR)
REV. A
ADG725/ADG731
–5–
TIMING CHARACTERISTICS1, 2
Parameter
Limit at TMIN, TMAX
Unit
Conditions/Comments
fSCLK
30
MHz max
SCLK Cycle Frequency
t1
33
ns min
SCLK Cycle Time
t2
13
ns min
SCLK High Time
t3
13
ns min
SCLK Low Time
t4
13
ns min
SYNC to SCLK Falling Edge Setup Time
t5
40
ns min
Minimum
SYNC Low Time
t6
5
ns min
Data Setup Time
t7
4.5
ns min
Data Hold Time
t8
33
ns min
Minimum
SYNC High Time
NOTES
1See Figure 1.
2All input signals are specified with tr = tf = 5 ns (10% to 90% of V
DD) and timed from a voltage level of (V IL + VIH)/2.
Specifications subject to change without notice.
SCLK
SYNC
DIN
DB7
DB0
t
8
t
4
t
5
t
6
t
7
t
2
t
3
t
1
Figure 1. 3-Wire Serial Interface Timing Diagram
A3
A2
A1
A0
EN
CSA
X
DB0 (LSB)
DB7 (MSB)
DATA BITS
CSB
Figure 2. ADG725 Input Shift Register Contents
A3
A2
A1
A0
EN
CS
X
DB0 (LSB)
DB7 (MSB)
DATA BITS
A4
Figure 3. ADG731 Input Shift Register Contents
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PDF描述
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ADG731BSUZ 制造商:Analog Devices 功能描述:IC, ANALOG MULTIPLEXER, DUAL 16X1 TQFP48
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