AVDD = DV
參數(shù)資料
型號: ADF4157BRUZ-RL7
廠商: Analog Devices Inc
文件頁數(shù): 19/24頁
文件大小: 0K
描述: IC PLL FREQ SYNTH 6GHZ 16TSSOP
標(biāo)準(zhǔn)包裝: 1,000
類型: 分?jǐn)?shù) N 合成器(RF)
PLL:
輸入: CMOS,TTL
輸出: 時(shí)鐘
電路數(shù): 1
比率 - 輸入:輸出: 2:1
差分 - 輸入:輸出: 是/無
頻率 - 最大: 6GHz
除法器/乘法器: 是/是
電源電壓: 2.7 V ~ 3.3 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 16-TSSOP(0.173",4.40mm 寬)
供應(yīng)商設(shè)備封裝: 16-TSSOP
包裝: 帶卷 (TR)
配用: EVAL-ADF4157EB1Z-ND - BOARD EVALUATION FOR ADF4157
ADF4157
Data Sheet
Rev. D | Page 4 of 24
TIMING SPECIFICATIONS
AVDD = DVDD = 2.7 V to 3.3 V; VP = AVDD to 5.5 V; AGND = DGND = 0 V; TA = TMIN to TMAX, unless otherwise noted;
dBm referred to 50 .
Table 2.
Parameter
Limit at T
MIN to TMAX (B Version)
Unit
Test Conditions/Comments
t
1
20
ns min
LE setup time
t
2
10
ns min
Data to clock setup time
t
3
10
ns min
Data to clock hold time
t
4
25
ns min
Clock high duration
t
5
25
ns min
Clock low duration
t
6
10
ns min
Clock to LE setup time
t
7
20
ns min
LE pulse width
CLK
DATA
LE
DB23 (MSB)
DB22
DB2
(CONTROL BIT C3)
DB1
(CONTROL BIT C2)
DB0 (LSB)
(CONTROL BIT C1)
t1
t2
t3
t7
t6
t4
t5
05874-
002
Figure 2. Timing Diagram
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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