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參數(shù)資料
| 型號： | ADCLK948BCPZ-REEL7 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 3/12頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK BUFFER MUX 2:8 32-LFCSP |
| 標(biāo)準(zhǔn)包裝： | 1,500 |
| 系列： | SIGe |
| 類型： | 扇出緩沖器（分配），多路復(fù)用器 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:8 |
| 差分 - 輸入:輸出： | 是/是 |
| 輸入： | CML，CMOS，LVDS，LVPECL |
| 輸出： | LVPECL |
| 頻率 - 最大： | 4.8GHz |
| 電源電壓： | 2.97 V ~ 3.63 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-VFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 32-LFCSP-VQ |
| 包裝： | 帶卷 (TR) |
ADCLK948
Rev. A | Page 11 of 12
INPUT TERMINATION OPTIONS
VREFx
VCC
VTx
CLKx
CONNECT VTxTO VCC.
50
08
28
0-
01
9
ADCLK948
Figure 19. DC-Coupled CML Input Termination
VREFx
VTx
VCC
50
CLKx
08
280
-02
0
0.01F
(OPTIONAL)
50
ADCLK948
Figure 20. DC-Coupled LVPECL Input Termination
VREFx
VTx
CONNECT VTxTO VREFx.
50
CLKx
08
28
0
-02
1
ADCLK948
Figure 21. AC-Coupled Input Termination, Such as LVDS and LEVPECL
VREFx
VTx
CONNECT VTx, VREFx, AND CLKx. PLACE A
BYPASS CAPACITOR FROM VTx TO GROUND.
ALTERNATIVELY, VTx, VREFx, AND CLKx CAN BE
CONNECTED, GIVING A CLEANER LAYOUT AND
A 180 PHASE SHIFT.
50
CLKx
08
28
0-
0
22
ADCLK948
Figure 22. AC-Coupled Single-Ended Input Termination
VREFx
VTx
50
CLKx
082
80
-02
3
ADCLK948
Figure 23. DC-Coupled 3.3 V CMOS Input Termination
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ADCLK950BCPZ | IC CLOCK BUFFER MUX 2:10 40LFCSP |
| ADCLK954BCPZ-REEL7 | IC CLOCK BUFFER MUX 2:12 40LFCSP |
| ADCMP343YRJZ-REEL7 | IC COMPARATOR DUAL OD SOT23-8 |
| ADCMP356YKS-REEL7 | IC COMP/REF PP ACTIVE HI SC70-4 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| ADCLK954 | 制造商:AD 制造商全稱:Analog Devices 功能描述:Two Selectable Inputs, 12 LVPECL Outputs, SiGe Clock Fanout Buffer |
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