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參數(shù)資料
| 型號： | ADCLK944BCPZ-R7 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 9/12頁 |
| 文件大小： | 0K |
| 描述： | IC CLOCK BUFFER 1:4 7GHZ 16LFCSP |
| 標準包裝： | 1,500 |
| 系列： | SIGe |
| 類型： | 扇出緩沖器（分配） |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:4 |
| 差分 - 輸入:輸出： | 是/是 |
| 輸入： | CML，CMOS，LVDS，LVPECL |
| 輸出： | ECL，LVPECL |
| 頻率 - 最大： | 7GHz |
| 電源電壓： | 2.375 V ~ 3.63 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-WFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 16-LFCSP-WQ（3x3） |
| 包裝： | 帶卷 (TR) |
ADCLK944
Rev. 0 | Page 6 of 12
08
77
0-
00
1. EXPOSED PAD MUST BE CONNECTED
TO VEE.
PIN CONFIGURATION AND FUNCTION DESCRIPTIONS
2
12
11
10
Q1
NOTES
Q1
Q2
9
Q2
1
3
4
CLK
VREF
2
VT
CLK
6
Q
3
5
V
E
7
Q
3
8
V
C
1
6
V
E
1
5
Q
0
1
4
Q
0
1
3
V
C
TOP VIEW
(Not to Scale)
ADCLK944
Figure 2. Pin Configuration
Table 6. Pin Function Descriptions
Pin No.
Mnemonic
Description
1
CLK
Differential Input (Positive).
2
VT
Center Tap. This pin provides the center tap of a 100 Ω input resistor for the CLK and CLK inputs.
3
VREF
Reference Voltage. This pin provides the reference voltage for biasing ac-coupled CLK and CLK inputs.
4
CLK
Differential Input (Negative).
5, 16
VEE
Negative Supply Pin.
6, 7
Q3, Q3
Differential LVPECL Outputs.
8, 13
VCC
Positive Supply Pin.
9, 10
Q2, Q2
Differential LVPECL Outputs.
11, 12
Q1, Q1
Differential LVPECL Outputs.
14, 15
Q0, Q0
Differential LVPECL Outputs.
EPAD
The exposed pad must be connected to VEE.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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