Table 15. Fractional PLL Parameter Settings for fS
參數(shù)資料
型號(hào)： ADAU1961WBCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 19/76頁
文件大?。?/td> 0K
描述： IC STEREO AUD CODEC LP 32LFCSP
標(biāo)準(zhǔn)包裝： 1
類型： 音頻編解碼器
數(shù)據(jù)接口： I²C，串行，SPI?
分辨率（位）： 24 b
ADC / DAC 數(shù)量： 2 / 2
三角積分調(diào)變： 無
S/N 比，標(biāo)準(zhǔn) ADC / DAC (db)： 98 / 98
動(dòng)態(tài)范圍，標(biāo)準(zhǔn) ADC / DAC (db)： 96 / 98
電壓 - 電源，模擬： 2.97 V ~ 3.63 V
電壓 - 電源，數(shù)字： 2.97 V ~ 3.63 V
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 32-LFCSP-EP（5x5）
包裝： 托盤
ADAU1961
Data Sheet
Rev. A | Page 26 of 76
Table 15. Fractional PLL Parameter Settings for fS = 44.1 kHz (PLL Output = 45.1584 MHz = 1024 × fS)
MCLK Input (MHz)
Input Divider (X)
Integer (R)
Denominator (M)
Numerator (N)
R2: PLL Control Setting (Hex)
8
1
5
625
403
0x0271 0193 2901
12
1
3
625
477
0x0271 01DD 1901
13
1
3
8125
3849
0x1FBD 0F09 1901
14.4
2
6
125
34
0x007D 0022 3301
19.2
2
4
125
88
0x007D 0058 2301
19.68
2
4
1025
604
0x0401 025C 2301
19.8
2
4
1375
772
0x055F 0304 2301
24
2
3
625
477
0x0271 01DD 1B01
26
2
3
8125
3849
0x1FBD 0F09 1B01
27
2
3
1875
647
0x0753 0287 1B01
Table 16. Fractional PLL Parameter Settings for fS = 48 kHz (PLL Output = 49.152 MHz = 1024 × fS)
MCLK Input (MHz)
Input Divider (X)
Integer (R)
Denominator (M)
Numerator (N)
R2: PLL Control Setting (Hex)
8
1
6
125
18
0x007D 0012 3101
12
1
4
125
12
0x007D 000C 2101
13
1
3
1625
1269
0x0659 04F5 1901
14.4
2
6
75
62
0x004B 003E 3301
19.2
2
5
25
3
0x0019 0003 2B01
19.68
2
4
205
204
0x00CD 00CC 2301
19.8
2
4
825
796
0x0339 031C 2301
24
2
4
125
12
0x007D 000C 2301
26
2
3
1625
1269
0x0659 04F5 1B01
27
2
3
1125
721
0x0465 02D1 1B01
Table 17. Integer PLL Parameter Settings for fS = 48 kHz (PLL Output = 49.152 MHz = 1024 × fS)
MCLK Input (MHz)
Input Divider (X)
Integer (R)
Denominator (M)
Numerator (N)
R2: PLL Control Setting (Hex)1
12.288
1
4
Don’t care
0xXXXX XXXX 2001
24.576
1
2
Don’t care
0xXXXX XXXX 1001
1
X = don’t care.
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