參數(shù)資料
型號： AD9600ABCPZ-105
廠商： Analog Devices Inc
文件頁數(shù)： 72/72頁
文件大?。?/td> 0K
描述： IC ADC 10BIT 105MSPS 64LFCSP
標準包裝： 1
位數(shù)： 10
采樣率（每秒）： 105M
數(shù)據(jù)接口： 串行，SPI?
轉(zhuǎn)換器數(shù)目： 2
功率耗散（最大）： 650mW
電壓電源： 模擬和數(shù)字
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 64-LFCSP-VQ（9x9）
包裝： 托盤
輸入數(shù)目和類型： 4 個單端，單極；2 個差分，單極
AD9600
Rev. B | Page 9 of 72
SWITCHING SPECIFICATIONS
AVDD = 1.8 V, DVDD = 1.8 V, DRVDD = 3.3 V, maximum sample rate, 1.0 dBFS differential input, 1.0 V internal reference, DCS
enabled, unless otherwise noted.
Table 4.
Parameter
Temp
AD9600ABCPZ-105/
AD9600BCPZ-105
AD9600ABCPZ-125/
AD9600BCPZ-125
AD9600ABCPZ-150/
AD9600BCPZ-150
Min
Typ
Max
Min
Typ
Max
Min
Typ
Max
Unit
CLOCK INPUT PARAMETERS
Input Clock Rate
Full
625
MHz
Conversion Rate
DCS Enabled
Full
20
105
20
125
20
150
MSPS
DCS Disabled
Full
10
105
10
125
10
150
MSPS
CLK Period (tCLK)
Full
9.5
8
6.66
ns
CLK Pulse Width High
Divide-by-1 Mode,
DCS Enabled
Full
2.85
4.75
6.65
2.4
4
5.6
2.0
3.33
4.66
ns
Divide-by-1 Mode,
DCS Disabled
Full
4.28
4.75
5.23
3.6
4
4.4
3.0
3.33
3.66
ns
Divide-by-2 Mode,
DCS Enabled
Full
1.6
ns
Divide-by-3 Through Divide-
by-8 Modes, DCS Enabled
Full
0.8
ns
DATA OUTPUT PARAMETERS
CMOS Mode—DRVDD = 3.3 V
Data Propagation Delay (tPD)1
Full
2.2
4.5
6.4
2.2
4.5
6.4
2.2
4.5
6.4
ns
DCO Propagation Delay (tDCO)
Full
3.8
5.0
6.8
3.8
5.0
6.8
3.8
5.0
6.8
ns
Setup Time (tS)
Full
5.25
4.5
3.83
ns
Hold Time (tH)
Full
4.25
3.5
2.83
ns
CMOS Mode—DRVDD = 1.8 V
Data Propagation Delay (tPD)1
Full
2.4
5.2
6.9
2.4
5.2
6.9
2.4
5.2
6.9
ns
DCO Propagation Delay (tDCO)
Full
4.0
5.6
7.3
4.0
5.6
7.3
4.0
5.6
7.3
ns
Setup Time (tS)
Full
5.25
4.5
3.83
ns
Hold Time (tH)
Full
4.25
3.5
2.83
ns
LVDS Mode—DRVDD = 1.8 V
Data Propagation Delay (tPD)1
Full
3.0
3.7
4.4
3.0
3.8
4.5
3.0
3.8
4.5
ns
DCO Propagation Delay (tDCO)
Full
5.2
6.4
7.6
5.0
6.2
7.4
4.8
5.9
7.3
ns
CMOS Mode Pipeline Delay
(Latency)
Full
12
Cycles
LVDS Mode Pipeline Delay
(Latency) Channel A/Channel B
Full
12/12.5
Cycles
Aperture Delay (tA)
Full
1.0
ns
Aperture Uncertainty (Jitter, tJ)
Full
0.1
ps rms
Wake-Up Time2
Full
350
μs
OUT-OF-RANGE RECOVERY TIME
Full
2
3
Cycles
1 Output propagation delay is measured from the CLK+ and CLK pins 50% transition to the output data pins 50% transition, with 5 pF load.
2 Wake-up time is dependent on the value of the decoupling capacitors.
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PDF描述
VE-241-IW-F3 CONVERTER MOD DC/DC 12V 100W
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參數(shù)描述
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AD9600ABCPZ-150 功能描述:IC ADC 10BIT 150MSPS 64LFCSP RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 模數(shù)轉(zhuǎn)換器 系列:- 標準包裝:1 系列:- 位數(shù):14 采樣率（每秒）:83k 數(shù)據(jù)接口:串行，并聯(lián) 轉(zhuǎn)換器數(shù)目:1 功率耗散（最大）:95mW 電壓電源:雙 ± 工作溫度:0°C ~ 70°C 安裝類型:通孔 封裝/外殼:28-DIP（0.600"，15.24mm） 供應(yīng)商設(shè)備封裝:28-PDIP 包裝:管件 輸入數(shù)目和類型:1 個單端，雙極
AD9600BCPZ-105 制造商:Analog Devices 功能描述:ADC Dual Pipelined 105Msps 10-bit Parallel/LVDS 64-Pin LFCSP EP
AD9600BCPZ-125 制造商:Analog Devices 功能描述:ADC Dual Pipelined 125Msps 10-bit Parallel/LVDS 64-Pin LFCSP EP
AD9600BCPZ-150 制造商:Analog Devices 功能描述:
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