參數(shù)資料
型號(hào)： AD9553/PCBZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 41/44頁(yè)
文件大?。?/td> 0K
描述： BOARD EVAL FOR AD9553
設(shè)計(jì)資源： AD9553 Eval Brd BOM
AD9553 Eval Brd Schematic
標(biāo)準(zhǔn)包裝： 1
主要目的： 計(jì)時(shí)，時(shí)鐘緩沖器 / 驅(qū)動(dòng)器 / 接收器 / 變換器
已用 IC / 零件： AD9553
已供物品： 板
相關(guān)產(chǎn)品： AD9553BCPZ-ND - IC INTEGER-N CLCK GEN 32LFCSP
AD9553BCPZ-REEL7-ND - IC INTEGER-N CLCK GEN 32LFCSP
AD9553
Rev. A | Page 6 of 44
OUTPUT CHARACTERISTICS
Table 8.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
LVPECL MODE
Differential Output Voltage Swing
690
800
890
mV
Output driver static (for dynamic performance, see
Common-Mode Output Voltage
VDD 1.66
VDD 1.34
VDD 1.01
V
Output driver static
Frequency Range
0
810
MHz
Duty Cycle
40
60
%
Up to 805 MHz output frequency
Rise/Fall Time1 (20% to 80%)
255
305
ps
100 Ω termination between both pins of the
output driver
LVDS MODE
Differential Output Voltage Swing
Output driver static (for dynamic performance, see
Balanced, V
OD
297
398
mV
Voltage swing between the pins of a differential
output pair with the output driver static
Unbalanced, ΔV
OD
8.3
mV
Absolute difference between voltage swing of
normal pin and inverted pin with the output
driver static
Offset Voltage
Common Mode, V
OS
1.17
1.35
V
(V
OH + VOL)/2 across a differential pair with output
driver static
Common-Mode Difference, ΔV
OS
7.3
mV
This is the absolute value of the difference
between V
OS when the normal output is high vs.
when the complementary output is high with
output driver static
Short-Circuit Output Current
17
24
mA
Output shorted to GND
Frequency Range
0
810
MHz
Duty Cycle
40
60
%
Up to 805 MHz output frequency
Rise/Fall Time1 (20% to 80%)
285
355
ps
100 Ω termination between both pins of the
output driver
CMOS MODE
Output Voltage High, V
OH
Output driver static; standard drive strength setting
I
OH = 10 mA
2.8
V
I
OH = 1 mA
2.8
V
Output Voltage Low, V
OL
Output driver static; standard drive strength setting
I
OL = 10 mA
0.5
V
I
OL = 1 mA
0.3
V
Frequency Range
0
200
MHz
3.3 V CMOS; standard drive strength setting;
output toggle rates in excess of the maximum are
possible, but with reduced amplitude (see Figure 17)
Duty Cycle
45
55
%
At maximum output frequency
Rise/Fall Time1 (20% to 80%)
500
745
ps
3.3 V CMOS; standard drive strength setting;
10 pF load
1 The listed values are for the slower edge (rise or fall).
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PDF描述
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參數(shù)描述
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AD9554-1/PCBZ 功能描述:AD9554-1 - Timing, Clock Generator Evaluation Board 制造商:analog devices inc. 系列:- 零件狀態(tài):有效 主要用途:計(jì)時(shí)，時(shí)鐘發(fā)生器 嵌入式:- 使用的 IC/零件:AD9554-1 主要屬性:- 輔助屬性:LED 狀態(tài)指示器 所含物品:板 標(biāo)準(zhǔn)包裝:1
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AD9554-1BCPZ-REEL7 功能描述:IC PLL CLOCK GEN 4OUT 72LFCSP 制造商:analog devices inc. 系列:- 包裝:帶卷（TR） 零件狀態(tài):有效 PLL:是 主要用途:以太網(wǎng)，SONET/SDH，Stratum 輸入:CMOS，LVDS 輸出:HCSL，LVDS，LVPECL 電路數(shù):1 比率 - 輸入:輸出:4：4 差分 - 輸入:輸出:是/是 頻率 - 最大值:942MHz 電壓 - 電源:1.4 V ~ 2.625 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:56-WFQFN 裸焊盤，CSP 供應(yīng)商器件封裝:56-LFCSP-WQ（8x8） 標(biāo)準(zhǔn)包裝:750
AD9554BCPZ 功能描述:IC CLOCK TRANSLATOR 8OUT 72LFCSP 制造商:analog devices inc. 系列:- 包裝:托盤 零件狀態(tài):有效 PLL:是 主要用途:以太網(wǎng)，SONET/SDH，Stratum 輸入:CMOS，LVDS 輸出:HCSL，LVDS，LVPECL 電路數(shù):1 比率 - 輸入:輸出:4：8 差分 - 輸入:輸出:是/是 頻率 - 最大值:941MHz 電壓 - 電源:1.47 V ~ 1.89 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:72-VFQFN 裸露焊盤，CSP 供應(yīng)商器件封裝:72-LFCSP-VQ（10x10） 標(biāo)準(zhǔn)包裝:1
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