參數(shù)資料
型號： AD9516-3BCPZ-REEL7
廠商： Analog Devices Inc
文件頁數(shù)： 4/80頁
文件大小： 0K
描述： IC CLOCK PLL/VCO 2GHZ 64LFCSP
標準包裝： 750
類型： 時鐘發(fā)生器，扇出配送
PLL： 是
輸入： 時鐘
輸出： CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 1:14
差分 - 輸入:輸出： 是/是
頻率 - 最大： 2.25GHz
除法器/乘法器： 是/無
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 64-LFCSP-VQ（9x9）
包裝： 帶卷 (TR)
配用： AD9516-3/PCBZ-ND - BOARD EVAL FOR AD9516-3 2.0GHZ
AD9516-3
Data Sheet
Rev. C | Page 12 of 80
DELAY BLOCK ADDITIVE TIME JITTER
Table 13.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
DELAY BLOCK ADDITIVE TIME JITTER1
Incremental additive jitter
100 MHz Output
Delay (1600 A, 0x1C) Fine Adj. 000000
0.54
ps rms
Delay (1600 A, 0x1C) Fine Adj. 101111
0.60
ps rms
Delay (800 A, 0x1C) Fine Adj. 000000
0.65
ps rms
Delay (800 A, 0x1C) Fine Adj. 101111
0.85
ps rms
Delay (800 A, 0x4C) Fine Adj. 000000
0.79
ps rms
Delay (800 A, 0x4C) Fine Adj. 101111
1.2
ps rms
Delay (400 A, 0x4C) Fine Adj. 000000
1.2
ps rms
Delay (400 A, 0x4C) Fine Adj. 101111
2.0
ps rms
Delay (200 A, 0x1C) Fine Adj. 000000
1.3
ps rms
Delay (200 A, 0x1C) Fine Adj. 101111
2.5
ps rms
Delay (200 A, 0x4C) Fine Adj. 000000
1.9
ps rms
Delay (200 A, 0x4C) Fine Adj. 101111
3.8
ps rms
1
This value is incremental. That is, it is in addition to the jitter of the LVDS or CMOS output without the delay. To estimate the total jitter, the LVDS or CMOS output jitter
should be added to this value using the root sum of the squares (RSS) method.
SERIAL CONTROL PORT
Table 14.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
CS (INPUT)
CS has an internal 30 k pull-up resistor
Input Logic 1 Voltage
2.0
V
Input Logic 0 Voltage
0.8
V
Input Logic 1 Current
3
A
Input Logic 0 Current
110
A
Input Capacitance
2
pF
SCLK (INPUT)
SCLK has an internal 30 k pull-down resistor
Input Logic 1 Voltage
2.0
V
Input Logic 0 Voltage
0.8
V
Input Logic 1 Current
110
A
Input Logic 0 Current
1
A
Input Capacitance
2
pF
SDIO (WHEN INPUT)
Input Logic 1 Voltage
2.0
V
Input Logic 0 Voltage
0.8
V
Input Logic 1 Current
10
nA
Input Logic 0 Current
20
nA
Input Capacitance
2
pF
SDIO, SDO (OUTPUTS)
Output Logic 1 Voltage
2.7
V
Output Logic 0 Voltage
0.4
V
TIMING
Clock Rate (SCLK, 1/tSCLK)
25
MHz
Pulse Width High, tHIGH
16
ns
Pulse Width Low, tLOW
16
ns
SDIO to SCLK Setup, tDS
2
ns
SCLK to SDIO Hold, tDH
1.1
ns
SCLK to Valid SDIO and SDO, tDV
8
ns
CS to SCLK Setup and Hold, tS, tH
2
ns
CS Minimum Pulse Width High, tPWH
3
ns
相關(guān)PDF資料
PDF描述
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AD9516-4BCPZ 制造商:Analog Devices 功能描述:CLOCK GENERATOR, 1.8GHZ, LFCSP-64
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