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參數(shù)資料
| 型號： | AD9512BCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 34/48頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC CLOCK DIST 5OUT PLL 48LFCSP |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | 扇出緩沖器（分配），除法器 |
| PLL： | 無 |
| 輸入： | 時鐘 |
| 輸出： | CMOS，LVDS，LVPECL |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:5 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 1.2GHz |
| 除法器/乘法器： | 是/無 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-VFQFN 裸露焊盤，CSP |
| 供應(yīng)商設(shè)備封裝： | 48-LFCSP-VQ（7x7） |
| 包裝： | 托盤 |
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AD9512
Rev. A | Page 4 of 48
SPECIFICATIONS
Typical (Typ) is given for VS = 3.3 V ± 5%; TA = 25°C, RSET = 4.12 kΩ, unless otherwise noted. Minimum (Min) and Maximum (Max)
values are given over full VS and TA (40°C to +85°C) variation.
CLOCK INPUTS
Table 1.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
CLOCK INPUTS (CLK1, CLK2)1
Input Frequency
0
1.6
GHz
Input Sensitivity
1502
mV p-p
Jitter performance can be improved with higher slew
rates (greater swing).
Input Level
23
V p-p
Larger swings turn on the protection diodes and can
degrade jitter performance.
Input Common-Mode Voltage, VCM
1.5
1.6
1.7
V
Self-biased; enables ac coupling.
Input Common-Mode Range, VCMR
1.3
1.8
V
With 200 mV p-p signal applied; dc-coupled.
Input Sensitivity, Single-Ended
150
mV p-p
CLK2 ac-coupled; CLK2B ac bypassed to RF ground.
Input Resistance
4.0
4.8
5.6
kΩ
Self-biased.
Input Capacitance
2
pF
1 CLK1 and CLK2 are electrically identical; each can be used as either differential or single-ended input.
2 With a 50 Ω termination, this is 12.5 dBm.
3 With a 50 Ω termination, this is +10 dBm.
CLOCK OUTPUTS
Table 2.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
LVPECL CLOCK OUTPUTS
Termination = 50 Ω to VS 2 V
OUT0, OUT1, OUT2; Differential
Output level 3Dh (3Eh) (3Fh)<3:2> = 10b
Output Frequency
1200
MHz
See Figure 14
Output High Voltage (VOH)
VS 1.22
VS 0.98
VS 0.93
V
Output Low Voltage (VOL)
VS 2.10
VS 1.80
VS 1.67
V
Output Differential Voltage (VOD)
660
810
965
mV
LVDS CLOCK OUTPUTS
Termination = 100 Ω differential; default
OUT3, OUT4; Differential
Output level 40h (41h)<2:1> = 01b
3.5 mA termination current
Output Frequency
800
MHz
See Figure 15
Differential Output Voltage (VOD)
250
360
450
mV
Delta VOD
25
mV
Output Offset Voltage (VOS)
1.125
1.23
1.375
V
Delta VOS
25
mV
Short-Circuit Current (ISA, ISB)
14
24
mA
Output shorted to GND
CMOS CLOCK OUTPUTS
OUT3, OUT4
Single-ended measurements;
B outputs: inverted, termination open
Output Frequency
250
MHz
With 5 pF load each output; see Figure 16
Output Voltage High (VOH)
VS 0.1
V
@ 1 mA load
Output Voltage Low (VOL)
0.1
V
@ 1 mA load
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參數(shù)描述 |
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| AD9512-EP | 制造商:AD 制造商全稱:Analog Devices 功能描述:1.2 GHz Clock Distribution IC, 1.6 GHz Inputs, Dividers, Five Outputs |
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