參數(shù)資料
型號(hào)： AD8111ASTZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 27/29頁(yè)
文件大?。?/td> 0K
描述： IC VIDEO CROSSPOINT SWIT 80LQFP
標(biāo)準(zhǔn)包裝： 1
功能： 視頻交叉點(diǎn)開(kāi)關(guān)
電路： 1 x 16:8
電壓電源： 雙電源
電壓 - 電源，單路/雙路(±)： ±4.5 V ~ 5.5 V
電流 - 電源： 38mA
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 80-LQFP
供應(yīng)商設(shè)備封裝： 80-LQFP（12x12）
包裝： 管件
REV. A
AD8110/AD8111
–6–
Table III. Operation Truth Table
SER/
CE
UPDATE
CLK
DATA IN
DATA OUT
RESET
PAR
Operation/Comment
1
X
No change in logic.
01
f
Data i
Data i-40
1
0
The data on the serial DATA IN line is loaded
into serial register. The first bit clocked into
the serial register appears at DATA OUT 40
clocks later.
01
f
D0 . . . D4,
NA in Parallel
1
The data on the parallel data lines, D0–D4, are
A0 ...A2
Mode
loaded into the 40-bit serial shift register loca-
tion addressed by A0–A2.
0
X
1
X
Data in the 40-bit shift register transfers into the
parallel latches that control the switch array.
Latches are transparent.
X
0
X
Asynchronous operation. All outputs are disabled.
Remainder of logic is unchanged.
D
CLK
Q
3
TO
8
DECODER
A0
A1
A2
CLK
CE
UPDATE
8
128
DATA IN
(SERIAL)
(OUTPUT
ENABLE)
SER/PAR
RESET
(OUTPUT ENABLE)
OUT0 EN
DATA
OUT
PARALLEL
DATA
D Q
CLK
D Q
CLK
D Q
CLK
D Q
CLK
D1
D2
D3
D Q
CLK
D Q
CLK
D Q
CLK
D Q
CLK
D Q
CLK
OUT1 EN
OUT2 EN
OUT3 EN
OUT4 EN
OUT5 EN
OUT6 EN
OUT7 EN
D
LE
Q
CLR
OUT7
EN
OUTPUT ENABLE
SWITCH MATRIX
S
D1
Q
D0
S
D1
Q
D0
S
D1
Q
D0
S
D1
Q
D0
S
D1
Q
D0
S
D1
Q
D0
S
D1
Q
D0
S
D1
Q
D0
D Q
CLK
S
D1
Q
D0
D4
DECODE
D
LE
Q
CLR
OUT0
EN
D
LE
OUT0
B0
Q
D
LE
Q
OUT0
B1
D
LE
Q
OUT0
B2
D
LE
Q
OUT0
B3
D
LE
OUT1
B0
Q
D
LE
Q
CLR
OUT6
EN
D
LE
OUT7
B0
Q
D
LE
OUT7
B1
Q
D
LE
OUT7
B2
Q
D Q
CLK
S
D1
Q
D0
S
D1
Q
D0
D
LE
OUT7
B3
Q
S
D1
Q
D0
Figure 4. Logic Diagram
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PDF描述
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