IOUT LATCH SCLK SDIN SDO GND CLEAR FAULT REFOUT 0.1F 10" />
參數資料
型號: AD5422BREZ
廠商: Analog Devices Inc
文件頁數: 35/44頁
文件大?。?/td> 0K
描述: IC DAC 16BIT 1CH 24TSSOP
產品培訓模塊: Power Line Monitoring
Data Converter Fundamentals
DAC Architectures
設計資源: 16-Bit Fully Isolated Output Module Using AD5422 and ADuM1401 (CN0065)
Simplified 16-Bit Voltage Output and 4 mA-to-20 mA Output Solution Using AD5422 (CN0077)
標準包裝: 62
設置時間: 25µs
位數: 16
數據接口: MICROWIRE?,串行,SPI?
轉換器數目: 1
電壓電源: 模擬和數字,雙 ±
功率耗散(最大): 950mW
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 24-TSSOP(0.173",4.40mm)裸露焊盤
供應商設備封裝: 24-TSSOP 裸露焊盤
包裝: 管件
輸出數目和類型: 1 電流,單極;1 電流,雙極;1 電壓,單極;1 電壓,雙極
采樣率(每秒): 40k
產品目錄頁面: 782 (CN2011-ZH PDF)
AD5412/AD5422
Data Sheet
Rev. I | Page 40 of 44
IOUT
LATCH
SCLK
SDIN
SDO
GND
CLEAR
FAULT
REFOUT
0.1F
10F
2.7V
TO
5.5V
DGND
TXD
RXD
RTS
CD
VCC
ADC_IP
REF
1F
10k
1.2M
300pF
150k
C3
RSET
DVCC
AVDD
CAP2
CAP1
RL
500
AGND
0.1F
10F
150pF
VOUT
+VSENSE
–VSENSE
OP1177
10F
0.1F
AVSS
10k
RP
C2
22nF
C1
2.2nF
D1
D2
D3
D4
AVSS
DIGITAL
INTERFACE
UART
INTERFACE
AD5412/
AD5422
REFIN
0V
TO
–26.4V
10.8V
TO
26.4V
AVDD
HART_OUT
AD5700
4mA TO 20mA
CURRENTLOOP
06996-
079
Figure 82. AD5412/AD5422 in HART Configuration
LATCH
SCLK
SDIN
SDO
DVCC
AVSS
AVDD
+VSENSE
–VSENSE
IOUT
VOUT
+VSENSE
–VSENSE
IOUT
+VOUT
CCOMP
GND
CLEAR
FAULT
REFOUT
REFIN
CLEAR SELECT
DVCC
S ELECT
AD5412/
AD54221
24V
SMAJ24CA
4nF
24V FIELD SUPPLY
36V
10F
0.1F
10F
0.1F
–15V
INVERTING
BUCK
REGULATOR
–15V
VDD2
GND1
VIA
NC
GND1
VIC
VID
VIB
VOA
VOC
VOD
VOB
GND2
VE2
GND2
ADuM1400
10k
FIELD GROUND
ADuM1200
VDD1
M
IC
R
OC
ON
TR
OLLE
R
D
IGITA
L
OU
TP
U
TS
D
IGITA
L
INP
UT
S
0.1F
BACKP
L
ANE
I
NT
E
RF
ACE
BACKPLANE
SUPPLY
SMAJ36CA
4.7k
18
100
+
06996-
068
1ADDITIONAL PINS OMITTED FOR CLARITY.
Figure 83. AD5412/AD5422 in an Industrial Analog Output Module Application
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PDF描述
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參數描述
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