參數(shù)資料
型號： AD1955ARSZRL
廠商： Analog Devices Inc
文件頁數(shù)： 9/24頁
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描述： IC DAC AUDIO 16-24BIT 28SSOP
產(chǎn)品培訓(xùn)模塊： Data Converter Fundamentals
DAC Architectures
標(biāo)準(zhǔn)包裝： 1,500
位數(shù)： 16，24
數(shù)據(jù)接口： 串行
轉(zhuǎn)換器數(shù)目： 2
電壓電源： 模擬和數(shù)字
功率耗散（最大）： 210mW
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 28-SSOP（0.209"，5.30mm 寬）
供應(yīng)商設(shè)備封裝： 28-SSOP
包裝： 帶卷 (TR)
輸出數(shù)目和類型： 4 電流，單極
采樣率（每秒）： 192k
配用： EVAL-AD1955EBZ-ND - BOARD EVAL FOR AD1955
REV. 0
AD1955
–17–
DVDD
AVDD
L2
600Z
L3
600Z
C2
0.1 F
C1
0.1 F
MCLK
EF_RDATA
SDATA/EF_LDATA
BCLK/EF_BCLK
LRCLK/EF_WCLK
DSD_PHASE
DSD_RDATA
DSD_LDATA
DSD_SCLK
CDATA
CCLK
MUTE
ZEROR
ZEROL
PD/RST
IOUTL+
IOUTL–
IOUTR+
IOUTR–
DGND
AGND1 AGND2
IREF
FILTB
FILTR
DVDD
AVDD
AD1955
U1
AVDD
OR
VREF
VBIAS
VREFA
2.80V
C44
0.1 F
C43
47 F
R57
2.80k
R56
2.21k
+
CONNECT VBIAS TO VREFA FOR BEST PERFORMANCE
OR VREF FOR LOWER PARTS COUNT
600Z
L1
R1
2.49k
C3
0.1 F
C4
10 F
C5
0.1 F
C6
47 F
VREF
2.39V
+
MCLK
RDATA
SDATA
BCLK
LRCLK
DSD_PHASE
DSD_RDATA
DSD_LDATA
DSD_SCLK
CDATA
CLATCH
CCLK
MUTE
ZEROR
ZEROL
IOUTL+
IOUTL–
IOUTR+
IOUTR–
PD/RST
CLATCH
Figure 6. DAC Power Supply and Bypass
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PDF描述
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參數(shù)描述
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