參數資料
| 型號： | A42MX16-3PQG208I |
| 廠商： | Microsemi SoC |
| 文件頁數： | 13/142頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA MX SGL CHIP 24K 208-PQFP |
| 標準包裝： | 24 |
| 系列： | MX |
| 輸入/輸出數： | 140 |
| 門數： | 24000 |
| 電源電壓： | 3 V ~ 3.6 V，4.5 V ~ 5.5 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 208-BFQFP |
| 供應商設備封裝： | 208-PQFP（28x28） |
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40MX and 42MX FPGA Families
Re vi s i on 11
1-7
MultiPlex I/O Modules
42MX devices feature Multiplex I/Os and support 5.0V, 3.3V, and mixed 3.3V/5.0V operations.
The MultiPlex I/O modules provide the interface between the device pins and the logic array. Figure 1-9
is a block diagram of the 42MX I/O module. A variety of user functions, determined by a library macro
selection, can be implemented in the module. (Refer to the Antifuse Macro Library Guide for more
information.) All 42MX I/O modules contain tristate buffers, with input and output latches that can be
configured for input, output, or bidirectional operation.
All 42MX devices contain flexible I/O structures, where each output pin has a dedicated output-enable
control (Figure 1-9). The I/O module can be used to latch input or output data, or both, providing fast set-
up time. In addition, the Designer software tools can build a D-type flip-flop using a C-module combined
with an I/O module to register input and output signals. Refer to the Antifuse Macro Library Guide for
more details.
A42MX24 and A42MX36 devices also offer selectable PCI output drives, enabling 100% compliance with
version 2.1 of the PCI specification. For low-power systems, all inputs and outputs are turned off to
reduce current consumption to below 500
μA.
To achieve 5.0V or 3.3V PCI-compliant output drives on A42MX24 and A42MX36 devices, a chip-wide
PCI fuse is programmed via the Device Selection Wizard in the Designer software (Figure 1-10). When
the PCI fuse is not programmed, the output drive is standard.
Designer software development tools provide a design library of I/O macro functions that can implement
all I/O configurations supported by the MX FPGAs.
Note:
*Can be configured as a Latch or D Flip-Flop (Using
C-Module)
Figure 1-9
42MX I/O Module
Figure 1-10 PCI Output Structure of A42MX24 and A42MX36 Devices
Q
D
From Array
To Array
G/CLK*
Q
D
PAD
EN
Signal
PCI Enable
PCI
Fuse
Drive
STD
Output
相關PDF資料 |
PDF描述 |
|---|---|
| AMM25DRST-S288 | CONN EDGECARD 50POS .156 EXTEND |
| AT24HC02BN-SH-T | IC EEPROM 2KBIT 1MHZ 8SOIC |
| ACM43DRMT | CONN EDGECARD 86POS .156 WW |
| A1020B-2PQ100C | IC FPGA 2K GATES 100-PQFP COM |
| HMC49DRTN-S93 | CONN EDGECARD 98POS DIP .100 SLD |
相關代理商/技術參數 |
參數描述 |
|---|---|
| A42MX16-3TQ100 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:40MX and 42MX FPGA Families |
| A42MX16-3TQ100A | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:40MX and 42MX FPGA Families |
| A42MX16-3TQ100B | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:40MX and 42MX FPGA Families |
| A42MX16-3TQ100ES | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:40MX and 42MX FPGA Families |
| A42MX16-3TQ100I | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:40MX and 42MX FPGA Families |
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