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參數資料
| 型號： | A40MX02-FPL68 |
| 廠商： | Microsemi SoC |
| 文件頁數： | 75/142頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA MX SGL CHIP 3K 68-PLCC |
| 標準包裝： | 19 |
| 系列： | MX |
| 輸入/輸出數： | 57 |
| 門數： | 3000 |
| 電源電壓： | 3 V ~ 3.6 V，4.75 V ~ 5.25 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 68-LCC（J 形引線） |
| 供應商設備封裝： | 68-PLCC（24.23x24.23） |
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40MX and 42MX FPGA Families
1- 34
R e v i sio n 1 1
Note:
Identical timing for falling edge clock.
Figure 1-30 42MX SRAM Synchronous Read Operation
Figure 1-31 42MX SRAM Asynchronous Read Operation—Type 1 (Read Address Controlled)
Figure 1-32 42MX SRAM Asynchronous Read Operation—Type 2 (Write Address Controlled)
RCLK
REN
RDAD[5:0]
RD[7:0]
Old Data
Valid
t
RCKHL
t
CKHL
t
RENH
t
RCO
t
ADH
t
DOH
t
ADSU
New Data
t
RENSU
RDAD[5:0]
RD[7:0]
Data 1
t
RDADV
t
DOH
ADDR2
ADDR1
Data 2
t
RPD
WEN
WD[7:0]
WCLK
RD[7:0]
Old Data
Valid
t
WENH
t
RPD
t
WENSU
New Data
t
DOH
tADSU
WRAD[5:0]
BLKEN
t
ADH
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PDF描述 |
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參數描述 |
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