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參數(shù)資料
| 型號： | A1020B-1PQG100I |
| 廠商： | Microsemi SoC |
| 文件頁數(shù)： | 26/98頁 |
| 文件大小： | 0K |
| 描述： | IC FPGA 2K GATES 100-PQFP IND |
| 標(biāo)準(zhǔn)包裝： | 66 |
| 系列： | ACT™ 1 |
| LAB/CLB數(shù)： | 547 |
| 輸入/輸出數(shù)： | 69 |
| 門數(shù)： | 2000 |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-BQFP |
| 供應(yīng)商設(shè)備封裝： | 100-PQFP（14x20） |
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A1 28 0A T i m i n g C har a c t e r i st i c s (continued)
(W or s t - C as e M i l i t a r y Cond i t i o n s , V CC = 4.5 V, TJ = 1 25°C)
‘–1’ Speed
‘Std’ Speed
Parameter
Description
Min.
Max.
Min.
Max.
Units
TTL Output Module Timing1
tDLH
Data to Pad High
11.0
13.0
ns
tDHL
Data to Pad Low
13.9
16.4
ns
tENZH
Enable Pad Z to High
12.3
14.4
ns
tENZL
Enable Pad Z to Low
16.1
19.0
ns
tENHZ
Enable Pad High to Z
9.8
11.5
ns
tENLZ
Enable Pad Low to Z
11.5
13.6
ns
tGLH
G to Pad High
12.4
14.6
ns
tGHL
G to Pad Low
15.5
18.2
ns
dTLH
Delta Low to High
0.09
0.11
ns/pF
dTHL
Delta High to Low
0.17
0.20
ns/pF
CMOS Output Module Timing1
tDLH
Data to Pad High
14.0
16.5
ns
tDHL
Data to Pad Low
11.7
13.7
ns
tENZH
Enable Pad Z to High
12.3
14.4
ns
tENZL
Enable Pad Z to Low
16.1
19.0
ns
tENHZ
Enable Pad High to Z
9.8
11.5
ns
tENLZ
Enable Pad Low to Z
11.5
13.6
ns
tGLH
G to Pad High
12.4
14.6
ns
tGHL
G to Pad Low
15.5
18.2
ns
dTLH
Delta Low to High
0.17
0.20
ns/pF
dTHL
Delta High to Low
0.12
0.15
ns/pF
Notes:
1.
Delays based on 50 pF loading.
2.
SSO information can be found in the Simultaneously Switching Output Limits for Actel FPGAs application note at
http://www.actel.com/appnotes.
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PDF描述 |
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參數(shù)描述 |
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| A1020B-1VQ84B | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ACT 1 Series FPGAs |
| A1020B-1VQ84C | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ACT 1 Series FPGAs |
| A1020B-1VQ84I | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:ACT 1 Series FPGAs |
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