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參數(shù)資料
| 型號(hào)： | A1010B-1PL68I |
| 廠商： | Microsemi SoC |
| 文件頁(yè)數(shù)： | 9/98頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 1200 GATES 68-PLCC IND |
| 標(biāo)準(zhǔn)包裝： | 19 |
| 系列： | ACT™ 1 |
| LAB/CLB數(shù)： | 295 |
| 輸入/輸出數(shù)： | 57 |
| 門數(shù)： | 1200 |
| 電源電壓： | 4.5 V ~ 5.5 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 68-LCC（J 形引線） |
| 供應(yīng)商設(shè)備封裝： | 68-PLCC（24.23x24.23） |
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17
Hi R e l F P GA s
1 200 XL T i m i ng Mo de l *
*Values shown for A1280XL–1 at worst-case military conditions.
Input module predicted routing delay.
Output Delays
Internal Delays
Input Delays
tINH = 0.0 ns
tINSU = 0.4 ns
I/O Module
D
Q
tINGL = 3.7 ns
tINYL = 1.7 ns t
IRD2 = 5.2 ns
Combinatorial
Logic Module
tPD = 3.7 ns
Sequential
Logic Module
I/O Module
tRD1 = 1.7 ns
tDLH = 6.6 ns
I/O Module
ARRAY
CLOCKS
FMAX = 110 MHz
Combin-
atorial
Logic
included
in tSUD
D
Q
D
Q
tOUTH = 0.0 ns
tOUTSU = 0.4 ns
tGLH = 5.9 ns
tDLH = 6.6 ns
tENHZ = 7.5 ns
tRD1 = 1.7 ns
tCO = 3.7 ns
tSU = 0.4 ns
tHD = 0.0 ns
tRD4 = 3.7 ns
tRD8 = 7.0 ns
Predicted
Routing
Delays
tCKH = 7.1 ns
G
FO = 256
tRD2 = 2.5 ns
tLCO = 10.7 ns (64 loads, pad-pad)
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