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參數(shù)資料
| 型號： | 74LVTH16500MEA |
| 廠商： | FAIRCHILD SEMICONDUCTOR CORP |
| 元件分類： | 通用總線功能 |
| 英文描述： | Low Voltage 18-Bit Universal Bus Transceivers with 3-STATE Outputs Preliminary |
| 中文描述： | LVT SERIES, 18-BIT REGISTERED TRANSCEIVER, TRUE OUTPUT, PDSO56 |
| 封裝： | 0.300 INCH, MO-118, SSOP-56 |
| 文件頁數(shù)： | 5/7頁 |
| 文件大?。?/td> | 67K |
| 代理商： | 74LVTH16500MEA |
Preliminary
5
www.fairchildsemi.com
7
AC Electrical Characteristics
Note 11:
Skew is defined as the absolute value of the difference between the actual propagation delay for any two separate outputs of the same device. The
specification applies to any outputs switching in the same direction, either HIGH-to-LOW (t
OSHL
) or LOW-to-HIGH (t
OSLH
).
Capacitance
(Note 12)
Note 12:
Capacitance is measured at frequency f
=
1 MHz, per MIL-STD-883, Method 3012.
Symbol
Parameter
T
A
=
40
°
C to
+
85
°
C, C
L
=
50 pF, R
L
=
500
V
CC
=
3.3
±
0.3V
Min
Max
150
1.3
3.7
Units
V
CC
=
2.7V
Min
150
1.3
Max
f
MAX
t
PLH
t
PHL
t
PLH
t
PHL
t
PLH
t
PHL
t
PZH
t
PZL
t
PHZ
t
PLZ
MHz
Propagation Delay
4.0
ns
Data to Outputs
Propagation Delay
LEBA or LEAB to B or A
1.3
1.5
1.5
3.7
5.1
5.1
1.3
1.5
1.5
4.0
5.7
5.7
ns
Propagation Delay
CLKBA or CLKAB to B or A
Output Enable Time
1.3
1.3
1.3
5.0
5.0
4.8
1.3
1.3
1.3
5.9
5.9
5.5
ns
ns
1.3
1.7
1.7
4.8
5.8
5.8
1.3
1.7
1.7
5.5
6.3
6.3
Output Disable Time
ns
t
SU
Setup Time
A before CLKAB
2.9
2.9
ns
B before CLKBA
2.9
2.9
A or B before LE, CLK HIGH
1.4
0.5
A or B before LE, CLK LOW
2.9
2.3
t
H
Hold Time
A or B after CLK
0.4
0.4
ns
A or B after LE
LE HIGH
1.6
3.3
1.6
3.3
t
W
Pulse Duration
ns
CLK HIGH or LOW
3.3
3.3
t
OSLH
t
OSHL
Output to Output Skew (Note 11)
1.0
1.0
ns
1.0
1.0
Symbol
C
IN
C
I/O
Parameter
Conditions
Typical
4
Units
pF
Input Capacitance
V
CC
=
0V, V
I
=
0V or V
CC
V
CC
=
3.0V, V
O
=
0V or V
CC
Input/Output Capacitance
8
pF
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 74LVTH16500MTD | Octal Bus Transceivers With 3-State Outputs 20-PDIP -40 to 85 |
| 74LVTH16501 | Low Voltage 18-Bit Universal Bus Transceivers with 3-STATE Outputs Preliminary |
| 74LVTH16501MEA | Low Voltage 18-Bit Universal Bus Transceivers with 3-STATE Outputs Preliminary |
| 74LVTH16501MTD | Low Voltage 18-Bit Universal Bus Transceivers with 3-STATE Outputs Preliminary |
| 74LVTH16501MEAX | 8K SPI 1K X 8, 17B PAGE, 2.5V SER EE, -40C to +85C, 8-TSSOP, TUBE |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 74LVTH16500MEA_Q | 功能描述:總線收發(fā)器 UB Transceiver 18Bit RoHS:否 制造商:Fairchild Semiconductor 邏輯類型:CMOS 邏輯系列:74VCX 每芯片的通道數(shù)量:16 輸入電平:CMOS 輸出電平:CMOS 輸出類型:3-State 高電平輸出電流:- 24 mA 低電平輸出電流:24 mA 傳播延遲時間:6.2 ns 電源電壓-最大:2.7 V, 3.6 V 電源電壓-最小:1.65 V, 2.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-48 封裝:Reel |
| 74LVTH16500MEAX | 功能描述:總線收發(fā)器 UB Transceiver LV 18Bit 3State RoHS:否 制造商:Fairchild Semiconductor 邏輯類型:CMOS 邏輯系列:74VCX 每芯片的通道數(shù)量:16 輸入電平:CMOS 輸出電平:CMOS 輸出類型:3-State 高電平輸出電流:- 24 mA 低電平輸出電流:24 mA 傳播延遲時間:6.2 ns 電源電壓-最大:2.7 V, 3.6 V 電源電壓-最小:1.65 V, 2.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-48 封裝:Reel |
| 74LVTH16500MTD | 功能描述:總線收發(fā)器 UB Transceiver 18Bit RoHS:否 制造商:Fairchild Semiconductor 邏輯類型:CMOS 邏輯系列:74VCX 每芯片的通道數(shù)量:16 輸入電平:CMOS 輸出電平:CMOS 輸出類型:3-State 高電平輸出電流:- 24 mA 低電平輸出電流:24 mA 傳播延遲時間:6.2 ns 電源電壓-最大:2.7 V, 3.6 V 電源電壓-最小:1.65 V, 2.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-48 封裝:Reel |
| 74LVTH16500MTD_Q | 功能描述:總線收發(fā)器 UB Transceiver 18Bit RoHS:否 制造商:Fairchild Semiconductor 邏輯類型:CMOS 邏輯系列:74VCX 每芯片的通道數(shù)量:16 輸入電平:CMOS 輸出電平:CMOS 輸出類型:3-State 高電平輸出電流:- 24 mA 低電平輸出電流:24 mA 傳播延遲時間:6.2 ns 電源電壓-最大:2.7 V, 3.6 V 電源電壓-最小:1.65 V, 2.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-48 封裝:Reel |
| 74LVTH16500MTDX | 功能描述:總線收發(fā)器 UB Transceiver LV 18Bit 3State RoHS:否 制造商:Fairchild Semiconductor 邏輯類型:CMOS 邏輯系列:74VCX 每芯片的通道數(shù)量:16 輸入電平:CMOS 輸出電平:CMOS 輸出類型:3-State 高電平輸出電流:- 24 mA 低電平輸出電流:24 mA 傳播延遲時間:6.2 ns 電源電壓-最大:2.7 V, 3.6 V 電源電壓-最小:1.65 V, 2.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TSSOP-48 封裝:Reel |
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