參數資料
型號： 74HCT192D
廠商： NXP SEMICONDUCTORS
元件分類： 通用總線功能
英文描述： Presettable synchronous BCD decade up/down counter
中文描述： HCT SERIES, SYN POSITIVE EDGE TRIGGERED 4-BIT BIDIRECTIONAL DECADE COUNTER, PDSO16
文件頁數： 12/13頁
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代理商： 74HCT192D
December 1990
12
Philips Semiconductors
Product specification
Presettable synchronous BCD decade
up/down counter
74HC/HCT192
Fig.10 Waveforms showing the master reset input (MR) pulse width, MR to Q
n
propagation delays, MR to CP
U
,
CP
D
removal time and output transition times.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
Fig.11 Waveforms showing the data input (D
n
) to parallel load input (PL) set-up and hold times.
The shaded areas indicate when the input is permitted
to change for predictable output performance.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
Fig.12 Waveforms showing the data input (D
n
), parallel load input (PL) and the master reset input (MR) to the
terminal count outputs (TC
U
, TC
D
) propagation delays.
(1) HC : V
M
= 50%; V
I
= GND to V
.
HCT: V
M
= 1.3 V; V
I
= GND to 3 V.
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