參數(shù)資料
型號： 74HC4059N3
廠商： NXP SEMICONDUCTORS
元件分類： 通用總線功能
英文描述： Programmable divide-by-n counter
中文描述： HC/UH SERIES, ASYN POSITIVE EDGE TRIGGERED DOWN DIVIDE BY N COUNTER, PDIP24
封裝： 0.300 INCH, PLASTIC, SOT-222-1, MS-001AF, DIP-24
文件頁數(shù)： 9/20頁
文件大小： 147K
代理商： 74HC4059N3
1998 Jul 08
9
Philips Semiconductors
Product specification
Programmable divide-by-n counter
74HC/HCT4059
DC CHARACTERISTIC FOR 74HC
For the DC characteristics see
“74HC/HCT/HCU/HCMOS Logic Family Specifications”
.
Output capability: standard
I
CC
category: MSI
AC CHARACTERISTICS FOR 74HC
GND = 0 V; t
r
= t
f
= 6 ns; C
L
= 50 pF
Note
1.
From master preset mode to any other mode.
SYMBOL PARAMETER
T
amb
(
°
C)
UNIT
TEST CONDITIONS
74HC
V
CC
(V)
WAVEFORMS
+
25
40 to
+
85
40 to
+
125
min. typ. max. min. max.
min.
max.
t
PHL
/ t
PLH
propagation delay
CP to Q
58
21
17
50
18
14
19
7
6
7
6
5
19
7
6
12
36
43
200
40
34
175
35
30
75
15
13
250
50
43
220
44
37
95
19
16
300
60
51
265
53
45
110
22
19
ns
2.0
4.5
6.0
2.0
4.5
6.0
2.0
4.5
6.0
2.0
4.5
6.0
2.0
4.5
6.0
2.0
4.5
6.0
Fig.7
t
PHL
/ t
PLH
propagation delay
LE to Q
ns
Fig.8
t
THL
/ t
TLH
output transition time
ns
Fig.7
t
W
clock pulse width
CP
90
18
15
75
15
13
4.2
21
25
115
23
90
95
19
16
3.4
17
20
135
27
23
110
22
19
2.8
14
17
ns
Fig.7
t
rem
removal time
K
b
, K
c
to CP
ns
Fig.9; note 1
f
max
maximum clock pulse
frequency
MHz
Fig.7
相關PDF資料
PDF描述
74HCT4059N3 Programmable divide-by-n counter
74HCT4059 Programmable divide-by-n counter
74HC4059 Programmable divide-by-n counter
74HC4060 14-stage binary ripple counter with oscillator
74HC4067 16-channel analog multiplexer/demultiplexer
相關代理商/技術參數(shù)
參數(shù)描述
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