參數(shù)資料
型號： 74HC174PW,118
廠商： NXP Semiconductors
文件頁數(shù)： 11/13頁
文件大小： 0K
描述： IC HEX D FF POSEDGE TRIG 16TSSOP
產(chǎn)品培訓(xùn)模塊： Logic Packages
標(biāo)準(zhǔn)包裝： 2,500
系列： 74HC
功能： 主復(fù)位
類型： D 型總線
輸出類型： 反相
元件數(shù)： 1
每個(gè)元件的位元數(shù)： 6
頻率 - 時(shí)鐘： 107MHz
延遲時(shí)間 - 傳輸： 16ns
觸發(fā)器類型： 正邊沿
輸出電流高，低： 5.2mA，5.2mA
電源電壓： 2 V ~ 6 V
工作溫度： -40°C ~ 125°C
安裝類型： 表面貼裝
封裝/外殼： 16-TSSOP（0.173"，4.40mm 寬）
包裝： 帶卷 (TR)
1998 Jul 08
7
Philips Semiconductors
Product specication
Hex D-type ip-op with reset; positive-edge trigger
74HC/HCT174
AC WAVEFORMS
Fig.6
Waveforms showing the clock (CP) to output
(Qn) propagation delays, the clock pulse
width, the output transition times and the
maximum clock pulses frequency.
(1)
HC : VM = 50%; VI = GND to VCC.
HCT : VM = 1.3 V; VI = GND to 3 V.
Fig.7
Waveforms showing the master reset (MR)
pulse width, the master reset to output (Qn)
propagation delays and the master reset to
clock (CP) removal time.
(1)
HC : VM = 50%; VI = GND to VCC.
HCT : VM = 1.3 V; VI = GND to 3 V.
Fig.8 Waveforms showing the data set-up and hold times for the data input (Dn).
The shaded areas indicate when the input is permitted to
change for predictable output performance
(1)
HC : VM = 50%; VI = GND to VCC.
HCT : VM = 1.3 V; VI = GND to 3 V.
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PDF描述
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