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參數(shù)資料
| 型號： | 554DD000129DG |
| 廠商： | SILICON LABORATORIES |
| 元件分類： | VCXO, clock |
| 英文描述： | VCXO, CLOCK, ECL OUTPUT |
| 封裝： | ROHS COMPLIANT PACKAGE-8 |
| 文件頁數(shù)： | 3/14頁 |
| 文件大?。?/td> | 238K |
| 代理商： | 554DD000129DG |
Si554
Rev. 0.6
11
6. 8-Pin PCB Land Pattern
Figure 4 illustrates the 8-pin PCB land pattern for the Si554. Table 13 lists the values for the dimensions shown in
the illustration.
Figure 4. Si554 PCB Land Pattern
Table 13. PCB Land Pattern Dimensions (mm)
Dimension
Min
Max
D2
5.08 REF
D3
5.705 REF
e
2.54 BSC
E2
4.20 REF
GD
0.84
—
GE
2.00
—
VD
8.20 REF
VE
7.30 REF
X1
1.70 TYP
X2
1.545 TYP
Y1
2.15 REF
Y2
1.3 REF
ZD
—
6.78
ZE
—
6.30
Note:
1. Dimensioning and tolerancing per the ANSI Y14.5M-1994
specification.
2. Land pattern design follows IPC-7351 guidelines.
3. All dimensions shown are at maximum material condition
(MMC).
4. Controlling dimension is in millimeters (mm).
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 554HC000249DGR | VCXO, CLOCK, ECL OUTPUT |
| 571ACC000107DG | VCXO, CLOCK, 10 MHz - 280 MHz, LVPECL OUTPUT |
| 571AEB000164DG | VCXO, CLOCK, 10 MHz - 810 MHz, LVPECL OUTPUT |
| 5G14E-150N-FREQ | VCXO, CLOCK, 1 MHz - 50 MHz, CMOS/TTL OUTPUT |
| 5G14F-150M-FREQ | VCXO, CLOCK, 1 MHz - 50 MHz, CMOS/TTL OUTPUT |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 554DD000330DG | 制造商:Silicon Laboratories Inc 功能描述:CNTRLD OSC 164.35547MHZ/167.33165MHZ/173.37075MHZ/176.83816M - Trays |
| 554DD000330DGR | 制造商:Silicon Laboratories Inc 功能描述:CNTRLD OSC 164.35547MHZ/167.33165MHZ/173.37075MHZ/176.83816M - Tape and Reel |
| 554DDXXXXXXBG | 制造商:SILABS 制造商全稱:SILABS 功能描述:SiPHY OC-192/STM-64 TRANSMITTER |
| 554DDXXXXXXBGR | 制造商:SILABS 制造商全稱:SILABS 功能描述:SiPHY OC-192/STM-64 TRANSMITTER |
| 554DE000332DGR | 制造商:Silicon Laboratories Inc 功能描述:CNTRLD OSC 622.08MHZ/672.1627MHZ/696.3993MHZ/718.8638MHZ VCX - Tape and Reel |
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