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參數(shù)資料
| 型號(hào)： | 54AC109 |
| 廠商： | National Semiconductor Corporation |
| 英文描述： | Dual JK Positive Edge-Triggered Flip-Flop |
| 中文描述： | 雙JK上升沿觸發(fā)器 |
| 文件頁數(shù)： | 5/8頁 |
| 文件大?。?/td> | 167K |
| 代理商： | 54AC109 |
AC Electrical Characteristics
54AC
V
CC
T
A = 55C
Fig.
Symbol
Parameter
(V)
to +125C
Units
No.
(Note 8)
C
L = 50 pF
Min
Max
f
max
Maximum Clock
3.3
65
MHz
Frequency
5.0
95
t
PLH
Propagation Delay
3.3
1.0
17.5
ns
CP
n to Qn or Qn
5.0
1.0
12.0
t
PHL
Propagation Delay
3.3
1.0
13.5
ns
CP
n to Qn or Qn
5.0
1.0
10.0
t
PLH
Propagation Delay
3.3
1.0
13.0
ns
C
Dn or SDn to Qn or Qn
5.0
1.0
9.5
t
PHL
Propagation Delay
3.3
1.0
14.0
ns
C
Dn or SDn to Qn or Qn
5.0
1.0
10.5
Note 8: Voltage Range 3.3 is 3.3V ±0.3V
Voltage Range 5.0 is 5.0V ±0.5V
AC Operating Requirements
54AC
V
CC
T
A = 55C
Fig.
Symbol
Parameter
(V)
to +125C
Units
No.
(Note 9)
C
L = 50 pF
Guaranteed
Minimum
t
s
Setup Time, HIGH or LOW
3.3
8.0
ns
J
n or Kn to CPn
5.0
5.5
t
h
Hold Time, HIGH or LOW
3.3
0
ns
J
n or Kn to CPn
5.0
0.5
t
w
Pulse Width
3.3
8.0
ns
C
Dn or SDn or CPn
5.0
5.5
t
rec
Recovery Time
3.3
0.5
ns
C
Dn or SDn to CPn
5.0
0.5
Note 9: Voltage Range 3.3 is 3.3V ±0.3V
Voltage Range 5.0 is 5.0V ±0.5V
5
www.national.com
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| 54AC109D | Dual JK Positive Edge-Triggered Flip-Flop |
| 54AC109F | CABLE ASSEMBLY; LEAD-FREE SOLDER; 10-32 MALE TO 10-32 MALE RIGHT ANGLE; 50 OHM, RG178B/U COAX |
| 54AC109L | Dual JK Positive Edge-Triggered Flip-Flop |
| 54AC10 | Triple 3-Input NAND Gate |
| 54AC10D | Triple 3-Input NAND Gate |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| 54AC109D | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:Dual JK Positive Edge-Triggered Flip-Flop |
| 54AC109DMQB | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:J-K-Type Flip-Flop |
| 54AC109F | 制造商:NSC 制造商全稱:National Semiconductor 功能描述:Dual JK Positive Edge-Triggered Flip-Flop |
| 54AC109FM | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Logic IC |
| 54AC109FMQB | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:J-K-Type Flip-Flop |
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