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參數(shù)資料
| 型號： | μPD789216Y |
| 廠商： | NEC Corp. |
| 英文描述： | 8 Bit Single Chip Microcontrollers(8 位單片微控制器) |
| 中文描述： | 8位單片機微控制器（8位單片微控制器） |
| 文件頁數(shù)： | 85/144頁 |
| 文件大小： | 632K |
| 代理商： | ΜPD789216Y |
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Preliminary Product Information
85
μ
PD789216Y, 789217Y
(c) SMB clock selection register 0 (SMBCL0)
This register sets the SMB transmission clock.
SMBCL0 is manipulated using a 1-bit or 8-bit memory manipulation instruction.
A RESET input clears SMBCL0 to 00H.
Figure 6-40. Format of SMB Clock Selection Register 0 (1/2)
0
0
CLD0
DAD0
SMC0
DFC0
CL01
CL00
SMBCL0
Symbol
Address
When reset
R/W
FF7AH
00H
R/W
Note 1
6
5
4
3
2
1
CLD0
0
1
Clear conditions (CLD0 = 0)
Cleared when SCL0 line is low level
Cleared when SMBE0 = 0
Cleared by RESET input
Set conditions (CLD0 = 1)
Set when SCL0 line is high level
SCL0 line level detection (valid only when SMBE0 = 1)
Detects that SCL0 line is low level.
Detects that SCL0 line is high level.
7
0
DAD0
0
1
Clear conditions (DAD0 = 0)
Cleared when SDA0 line is low level
Cleared when SMBE0 = 0
Cleared by RESET input
Set conditions (DAD0 = 1)
Set when SDA0 line is high level
SDA0 line level detection (valid only when SMBE0 = 1)
Detects that SDA0 line is low level.
Detects that SDA0 line is high level.
SMC0
0
1
Clear conditions (SMC0 = 0)
Cleared with instruction
Cleared by RESET input
Set conditions (SMC0 = 1)
Set with instruction
Operating mode switching
IIC standard mode or SMB mode operation
IIC high-speed mode
DFC0
0
1
Digital filter operation control
Note 2
Digital filter OFF
Digital filter ON
Notes 1.
Bits 4 and 5 are read-only.
2.
The digital filter can be used in the high-speed mode. When used in the high-speed mode, the digital
filter provides a slower response.
相關PDF資料 |
PDF描述 |
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