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參數(shù)資料
| 型號(hào)： | μPD789167Y |
| 廠商： | NEC Corp. |
| 英文描述： | 8 Bit Single Chip Microcontrollers(8 位單片微控制器) |
| 中文描述： | 8位單片機(jī)微控制器（8位單片微控制器） |
| 文件頁(yè)數(shù)： | 127/145頁(yè) |
| 文件大小： | 610K |
| 代理商： | ΜPD789167Y |
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Preliminary Product Information
126
μ
PD789166Y, 789167Y, 789176Y, 789177Y
(iii) AC characteristics
Parameter
Symbol
SMB mode
I
2
C standard mode
I
2
C high-speed mode
Unit
MIN.
MAX.
MIN.
MAX.
MIN.
MAX.
SCL0 clock frequency
f
CLK
10
100
0
100
0
400
kHz
Bus free time (between stop-start
conditions)
t
BUF
4.7
4.7
1.3
μ
s
Hold time
Note 1
t
HD:STA
4.0
4.0
0.6
μ
s
Start/restart condition setup time
t
SU:STA
4.7
4.7
0.6
μ
s
Stop condition setup time
t
SU:STO
4.0
4.0
0.6
μ
s
Data
hold time
CBUS-compatible
master
t
HD:DAT
500
μ
s
SMB/IIC
300
0
Note 2
900
Note 3
ns
Data setup time
t
SU:DAT
250
250
100
Note 4
ns
SCL0 clock low level width
t
LOW
4.7
4.7
1.3
μ
s
SCL0 clock high level width
t
HIGH
4.0
50
4.0
0.6
μ
s
SCL0 and SDA0 signal falling time
t
F
300
300
300
ns
SCL0 and SDA0 signal rising time
t
R
1,000
1,000
300
ns
Pulse width of spikes controlled by
the input filter
t
SP
0
50
ns
Time-out time
t
TIMEOUT
25
35
ms
SCL0 clock low level period total
extension time (slave)
t
LOW:SEXT
25
ms
Cumulative SCL0 clock low level
period total extension time
(master)
t
LOW:MEXT
10
ms
Capacitive load of each bus line
C
b
400
400
pF
Notes 1.
In the start condition, the first clock pulse is generated after this period of time.
2.
To fill the undefined area of the SCL0 falling edge (at V
IHmin.
of the SCL0 signal), the device needs to
internally provide a hold time of at least 300 ns for the SDA0 signal.
3.
If the device does not extend the low hold time (t
LOW
) of the SCL0 signal, the maximum data hold time
(t
HD:DAT
) only needs to be satisfied.
4.
I
conditions must be satisfied:
When the device does not extend the low hold time of the SCL0 signal
t
SU:DAT
≥
250 ns
When the device extends the low hold time of the SCL0 signal
Before SCL0 is released (t
Rmax.
+ t
SU:DAT
= 1,000 + 250 = 1,250 ns: in SMB mode or I
mode), the next data bit must be sent onto the SDA0 line.
2
C high-speed mode can be used in SMB mode and I
2
C standard mode. In this case, the following
2
C standard
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| μPD789166Y | 8 Bit Single Chip Microcontrollers(8 位單片微控制器) |
| μPD789176Y | 8 Bit Single Chip Microcontrollers(8 位單片微控制器) |
| μPD789177Y | 8 Bit Single Chip Microcontrollers(8 位單片微控制器) |
| μPD789187 | 8 Bit Single Chip Microcontrollers(8 位單片微控制器) |
| μPD789197 | 8 Bit Single Chip Microcontrollers(8 位單片微控制器) |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PD78F0134 | 制造商:NEC 制造商全稱:NEC 功能描述:8-Bit Single-Chip Microcontrollers |
| PD78F0134(A) | 制造商:NEC 制造商全稱:NEC 功能描述:8-Bit Single-Chip Microcontrollers |
| PD78F0134(A1) | 制造商:NEC 制造商全稱:NEC 功能描述:8-Bit Single-Chip Microcontrollers |
| PD78F0134A | 制造商:NEC 制造商全稱:NEC 功能描述:8-Bit Single-Chip Microcontrollers |
| PD78F0134A1 | 制造商:NEC 制造商全稱:NEC 功能描述:8-Bit Single-Chip Microcontrollers |
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