參數(shù)資料
型號(hào)： TMS320DM647ZUT720
廠商： Texas Instruments, Inc.
英文描述： Digital Media Processor
中文描述： 數(shù)字媒體處理器
文件頁數(shù)： 41/166頁
文件大?。?/td> 1341K
代理商： TMS320DM647ZUT720
www.ti.com
P
3.2.5
KEY_REG
TMS320DM647/TMS320DM648
Digital Media Processor
SPRS372–MAY 2007
Note that the configuration SCR port on the data SCR is considered a single endpoint meaning priority will
be enforced when multiple masters try to access the configuration SCR. Priority is also enforced on the
configuration SCR side when a master (through the data SCR) tries to access the same endpoint as the
C64x+ Megamodule.
The Ethernet Subsystem and VLYNQ fields specify the priority of the EMAC and VLYNQ peripherals,
respectively. Similarly, the HOST field applies to the priority of the HPI and PCI peripherals. Other master
peripherals are not present in the PRI_ALLOC register as they have their own registers to program their
priorities. For more information on the default priority values in these peripheral registers, see the
device-compatible peripheral reference guides.
TI recommends that these priority registers be reprogrammed upon initial use.
Table 3-5. Default Master Priorities
Master
EDMA3TC0
EDMA3TC1
EDMA3TC2
EDMA3TC3
64x+_DMAP
64x+_CFGP
Ethernet Subsystem
VLYNQ
UHPI
PCI
VICP
Default Priority
0 (EDMA CC QUEPRI Register)
0 (EDMA CC QUEPRI Register)
0 (EDMA CC QUEPRI Register)
0 (EDMA CC QUEPRI Register)
7 (C64x+ MDMAARBE.PRI Register bit field)
1 (C64x+ MDMAARBE.PRI Register bit field)
3 (PRI_ALLOC register)
4 (PRI_ALLOC register)
4 (PRI_ALLOC register)
4 (PRI_ALLOC register)
5 (PRI_ALLOC register)
Figure 3-4. Priority Allocation Register (PRI_ALLOC)
31
16
Reserved
R-0000000111001111
15
12
11
9
8
6
5
3
2
0
Reserved
VICP
VLYNQ
HOST
Ethernet Subsystem
R-0111
R/W-101
R/W-100
R/W-100
R/W-011
LEGEND: R/W = Read/Write; R = Read only; -
n
= value after reset
KEY_REG protects against accidental writes to certain system configuration registers. The complete set of
registers protected by the KEY_REG is:
PINMUX
BOOTCFG
PRI_ALLOC
CFGPLL
CFGRX0
CFGTX0
CFGRX1
CFGTX1
MAC_ADDR_RW0
MAC_ADDR_RW1
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Device Configuration
41
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PDF描述
TMS320DM647ZUT900 Digital Media Processor
TMS320DM648ZUT720 Digital Media Processor
TMS320DM648ZUT900 Digital Media Processor
TMX320DM647ZUT720 Digital Media Processor
TMX320DM647ZUT900 Digital Media Processor
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參數(shù)描述
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