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參數(shù)資料
| 型號(hào)： | STD150 |
| 英文描述： | STD150|Data Sheet |
| 中文描述： | STD150 |數(shù)據(jù)資料 |
| 文件頁(yè)數(shù)： | 580/751頁(yè) |
| 文件大?。?/td> | 5531K |
| 代理商： | STD150 |
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Samsung ASIC
5-39
STD150
DPSRAM_HD
High-Density Dual-Port Synchronous Static RAM
Parameter Description
DPSRAM_HD is the compiler that automatically generates symbol, netlist, timing model, power model and
layout according to the following parameters; Number of words(w), Number of bit per word(b) and Column
mux(y).
Pin Descriptions
Pin Capacitance
(Unit = SL)
NOTE:
Each pin’s capacitance is exactly same regardless of available mux types.
Parameters
Ymux(y) = 4
32
1024
16
1
128
1
Ymux(y) = 8
64
2048
32
1
64
1
Ymux(y) = 16
128
4096
64
1
32
1
Ymux(y) = 32
256
8192
128
1
16
1
Words (w)
Min
Max
Step
Min
Max
Step
Bpw (b)
Name
CK1
CK2
Type
Description
Clock
Clock input. CSN, WEN, A[] and DI[] are latched into the RAM on the rising
edge of CK. If CSN and WEN are low on the rising edge of CK, the RAM is in
write mode. If WEN is high on the rising edge of CK, the RAM is in read mode.
Upon the falling edge of CK, the RAM is in a precharge state.
Chip Enable Chip Enable input. The chip enable is active-low and is latched into the RAM
on the rising edge of CK. When CSN is low, the RAM is enabled for reading or
writing, depending on the state of WEN. When CSN is high, the RAM goes to
the standby mode and is disabled for reading or writing. DOUT remains previ-
ous data output.
Read/Write
Enable
the rising edge of CK. When WEN is low, data are written to the addressed
location and DOUT remains stable. When WEN is high, data from the
addressed word are present at DOUT.
Data Out-
put Enable
regardless of any inputs. When OEN is high, DOUT is disabled and goes to
high-impedance state.
Address
Address input bus. The address is latched into the RAM on the rising edge of
CK.
CSN1
CSN2
WEN1
WEN2
Read or write enable input. The read/write enable is latched into the RAM on
OEN1
OEN2
Data output enable input. The data output enable is asynchronously operated
A1 []
A2 []
DI1 []
DI2 []
DOUT1 []
DOUT2 []
Data Input
Data input bus. Data are latched on the rising edge of CK. Data input is written
into the addressed location in write mode.
Data Output
Data output bus. Data output is valid after the rising edge of CK while the RAM
is in read mode. Data output remains previous data output while the RAM is in
write mode.
CK
11.34
CSN
3.27
WEN
3.27
OEN
3.34
A
DI
4.45
DOUT
10.98
3.27
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| STD-15013T | 制造商:VOLGEN 制造商全稱:VOLGEN 功能描述:ADAPTER-18W |
| STD-1502 | 制造商:VOLGEN 制造商全稱:VOLGEN 功能描述:ADAPTER-30W |
| STD-1504 | 制造商:VOLGEN 制造商全稱:VOLGEN 功能描述:ADAPTER - 36W / 48W/ 60W |
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