參數(shù)資料
型號(hào)： STD150
英文描述： STD150|Data Sheet
中文描述： STD150 |數(shù)據(jù)資料
文件頁數(shù)： 570/751頁
文件大小： 5531K
代理商： STD150
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Samsung ASIC
5-29
STD150
SPSRAMR_HD
High-Density Single-Port Synchronous Static RAM with Redundancy
Parameter Description
SPSRAMR_HD is the compiler that automatically generates symbol, netlist, timing model, power model and
layout according to the following parameters; Number of words(w), Number of bit per word(b), Column
mux(y) and Number of banks(ba).
Pin Descriptions
Parameters
ba = 1
Ymux(y) = 8
2048
4096
64
4096
8192
128
32
128
1
Ymux(y) = 16
4096
8192
128
8192
16384
256
16
64
1
Ymux(y) = 32
8192
16384
256
16384
32768
512
8
32
1
Words (w)
Min
Max
Step
Min
Max
Step
Min
Max
Step
ba = 2
Bpw (b)
Name
CK
Type
Description
Clock
Clock input. CSN, WEN, A[] and DI[] are latched into the RAM on the rising
edge of CK. If CSN and WEN are low on the rising edge of CK, the RAM is in
write mode. If WEN is high on the rising edge of CK, the RAM is in read mode.
Upon the falling edge of CK, the RAM is in a precharge state.
Chip Enable Chip Enable input. The chip enable is active-low and is latched into the RAM
on the rising edge of CK. When CSN is low, the RAM is enabled for reading or
writing, depending on the state of WEN. When CSN is high, the RAM goes to
the standby mode and is disabled for reading or writing. DOUT remains previ-
ous data output.
Read/Write
Enable
the rising edge of CK. When WEN is low, data are written to the addressed
location and DOUT remains stable. When WEN is high, data from the
addressed word are present at DOUT.
Bit-Write
Enable
rising edge of CK. Each bit of BWEN[] enables/disables the write operation of
corresponding data bit. BWEN[i] corresponds to DI[i] in bit-write. If WEN and
BWEN[0] are low and BWEN[1] is high, DI[0] is written into the memory loca-
tion specified on A[], but DI[1] is not written.
Data Out-
put Enable
regardless of any input. When OEN is high, DOUT is disabled and goes to
high-impedance state.
Address
Address input bus. The address is latched into the RAM on the rising edge of
CK.
Data Input
Data input bus. Data are latched on the rising edge of CK. Data input is written
into the addressed location in write mode.
Data Output
Data output bus. Data output is valid after the rising edge of CK while the RAM
is in read mode. Data output remains previous data output while the RAM is in
write mode.
CSN
WEN
Read or write enable input. The read/write enable is latched into the RAM on
BWEN[]
Bit-write enable input bus. The bit-write enable is latched into the RAM on the
OEN
Data output enable input. The data output enable is asynchronously operated
A[]
DI[]
DOUT[]
相關(guān)PDF資料
PDF描述
STD15N06-1 TRANSISTOR | MOSFET | N-CHANNEL | 60V V(BR)DSS | 15A I(D) | TO-251
STD15N06L-1 TRANSISTOR | MOSFET | N-CHANNEL | 60V V(BR)DSS | 15A I(D) | TO-251
STD15N06LT4 TRANSISTOR | MOSFET | N-CHANNEL | 60V V(BR)DSS | 15A I(D) | TO-252
STD15N06T4 TRANSISTOR | MOSFET | N-CHANNEL | 60V V(BR)DSS | 15A I(D) | TO-252
STD15NF10 N - CHANNEL 100V - 0.073ohm - 15A TO-252 LOW GATE CHARGE STripFET POWER MOSFET
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參數(shù)描述
STD-150 制造商:Radio Design Labs 功能描述:Passive Audio Combiner/Divider 制造商:RADIO DESIGN LABS 功能描述:AUDIO COMBINER/DIVIDER PASSIVE
STD-15010T 制造商:VOLGEN 制造商全稱:VOLGEN 功能描述:ADAPTER-18W
STD-15013T 制造商:VOLGEN 制造商全稱:VOLGEN 功能描述:ADAPTER-18W
STD-1502 制造商:VOLGEN 制造商全稱:VOLGEN 功能描述:ADAPTER-30W
STD-1504 制造商:VOLGEN 制造商全稱:VOLGEN 功能描述:ADAPTER - 36W / 48W/ 60W
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