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參數(shù)資料
| 型號： | STD130 |
| 英文描述： | STD130|Data Sheet |
| 中文描述： | STD130 |數(shù)據(jù)資料 |
| 文件頁數(shù)： | 797/878頁 |
| 文件大小： | 2617K |
| 代理商： | STD130 |
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STD130
5-194
Samsung ASIC
DPSRAM_LP
Low-Power Dual-Port Synchronous Static RAM
Parameter Description
DPSRAM_LP is the compiler that automatically generates symbol, netlist, timing model, power model and
layout according to the following parameters; Number of words(w), Number of bit per word(b) and Column
mux(y).
Pin Descriptions
Pin Capacitance
(Unit = SL)
NOTE:
Each pin’s capacitance is exactly same regardless of available mux types.
Parameters
Ymux = 2
32
2048
16
1
128
1
Ymux = 4
64
4096
32
1
64
1
Ymux = 8
128
8192
64
1
32
1
Ymux = 16
256
16384
128
1
16
1
Words (w)
Min
Max
Step
Min
Max
Step
Bpw (b)
Name
CK1
CK2
Type
Description
Clock
Clock input. CSN, WEN, A[] and DI[] are latched into the RAM on the rising
edge of CK. If CSN and WEN are low on the rising edge of CK, the RAM is in
write mode. If WEN is high on the rising edge of CK, the RAM is in read
mode. Upon the falling edge of CK, the RAM is in a precharge state.
Chip enable input. The chip enable is active-low and is latched into the RAM
on the rising edge of CK. When CSN is low, the RAM is enabled for reading
or writing, depending on the state of WEN. When CSN is high, the RAM goes
to the standby mode and is disabled for reading or writing. DOUT remains
previous data output.
Read or write enable input. The read/write enable is latched into the RAM on
the rising edge of CK. When WEN is low, data are written to the addressed
location and DOUT remains stable. When WEN is high, data from the
addressed word are present at DOUT.
Data output enable input. The data output enable is asynchronously operated
regardless of the state of other inputs. When OEN is high, DOUT is disabled
and goes to high-impedance state.
Address input bus. The address is latched into the RAM on the rising edge of
CK.
CSN1
CSN2
Chip
Enable
WEN1
WEN2
Read/Write
Enable
OEN1
OEN2
Data
Output
Enable
Address
A1 [ ]
A2 [ ]
DI1 [ ]
DI2 [ ]
DOUT1 [ ]
DOUT2 [ ]
Data Input
Data input bus. Data are latched on the rising edge of CK. Data input is
written into the addressed location in write mode.
Data
Output
Data output bus. Data output is valid after the rising edge of CK while the
RAM is in read mode. Data output remains previous data output while the
RAM is in write mode.
CK
13.70
CSN
3.43
WEN
3.39
OEN
4.57
A
DI
3.39
DOUT
7.47
3.39
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| STD131 | STD131|Data Sheet |
| STD150 | STD150|Data Sheet |
| STD15N06-1 | TRANSISTOR | MOSFET | N-CHANNEL | 60V V(BR)DSS | 15A I(D) | TO-251 |
| STD15N06L-1 | TRANSISTOR | MOSFET | N-CHANNEL | 60V V(BR)DSS | 15A I(D) | TO-251 |
| STD15N06LT4 | TRANSISTOR | MOSFET | N-CHANNEL | 60V V(BR)DSS | 15A I(D) | TO-252 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| STD13003 | 制造商:AUK 制造商全稱:AUK corp 功能描述:NPN Silicon Power Transistor |
| STD13003D | 制造商:KODENSHI 制造商全稱:KODENSHI KOREA CORP. 功能描述:NPN Silicon Power Transistor |
| STD13003L | 制造商:AUK 制造商全稱:AUK corp 功能描述:NPN Silicon Power Transistor |
| STD13003Q | 制造商:KODENSHI 制造商全稱:KODENSHI KOREA CORP. 功能描述:SWITCHING REGULATOR APPLICATIONS |
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