參數(shù)資料
型號： ST92163R4
英文描述： 8/16-BIT FULL SPEED USB MCU FOR COMPOSITE DEVICES WITH 16 ENDPOINTS. 20K ROM. 2K RAM. I 2 C. SCI. & MFT
中文描述： 16位產(chǎn)品全速USB微控制器，16終點復(fù)合設(shè)備。 20,000光盤。 2K的RAM。余2長脊髓損傷。
文件頁數(shù)： 205/230頁
文件大?。?/td> 2743K
代理商： ST92163R4
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205/230
ST92163 - ELECTRICAL CHARACTERISTICS
DC ELECTRICAL CHARACTERISTICS
(V
DD
= 4.0 - 5.5V, T
A
= 0°C + 70°C, unless otherwise specified)
1
1
*For devices with suffix L or V, these characteristics are valid for V
DD
= 3.0 - 5.5V
Notes:
1. All I/O Ports are configured in bidirectional weak pull-up mode with no DC load external clock pin (OSCIN) is driven by square wave external
clock. No peripheral working.
2. Hysteresis voltage between switching levels: characterization results - not tested.
Symbol
Parameter
Test Conditions
Value
Typ.
Unit
Min.
0.7 V
DD
– 0.3
2.0
0.7 V
DD
TBD
Max.
V
DD
+ 0.3
0.3 V
DD
V
DD
+ 0.3
V
DD
+ 0.3
TBD
V
IHCK
*
V
ILCK
*
Clock Input High Level
Clock Input Low Level
External Clock
External Clock
TTL
CMOS
Input threshold
V
V
V
V
V
V
IH
*
Input High Level
P0[7:0], P1[7:0], P6[5:2],P6.7
Input High Level
Schmitt Trigger
P3[7:0], P4[3:0],P5[7:0], P6[1:0],
P6.6
Input Voltage Range
TBD
TBD
V
V
IL
*
Input Low Level
P0[7:0], P1[7:0], P6[5:2], P6.7
TTL
CMOS
Input threshold
– 0.3
– 0.3
TBD
0.8
V
V
V
0.3 V
DD
TBD
Input Low Level
Schmitt Trigger
P3[7:0], P4[3:0],P5[7:0], P6[1:0],
P6.6
Input Hysteresis Schmitt trigger
P3[7:0], P4[3:0],P5[7:0], P6[1:0],
P6.6
RESET Input High Level
Input Voltage Range
TBD
TBD
V
V
HYS
2
TBD
TBD
V
IHRS
*
Input threshold
Input Voltage Range
Input threshold
Input Voltage Range
0.5 V
DD
0.85 V
DD
0.2 V
DD
-0.3
0.3
V
DD
– 0.8
0.85 V
DD
V
DD
+ 0.3
0.6 V
DD
0.2 V
DD
1.5
V
V
ILRS
*
RESET Input Low Level
V
V
HYRS
*
V
OH
*
RESET Input Hysteresis
Output High Level
V
V
Push Pull, Iload = – 0.8mA
Push Pull or Open Drain,
Iload = 1.6mA
V
OL
Output Low Level
0.4
V
Output Low Level high sink pins
(Port 6)
Iload = 10mA
1
V
I
WPU
Weak Pull-up Current
Bidirectional Weak Pull-up,
V
OL
= 0V
– 40
– 200
– 420
μ
A
I
APU
Active Pull-up Current,
V
IN
< 0.8V, under Reset
– 40
– 200
– 420
μ
A
I
LKIO
*
I/O Pin Input Leakage
Input/Tri-State,
0V < V
IN
< V
DD
0V < V
IN
< V
DD
– 10
+ 10
μ
A
I
LKRS
*
I
LKA/D
*
I
LKAP
*
I
LKOS
*
RESET Pin Input Leakage
A/D Conv. Input Leakage
Active Pull-up Input Leakage
– 10
– 3
– 10
+ 10
+ 3
+ 10
μ
A
μ
A
μ
A
0V < V
IN
< 0.8V
OSCIN Pin Input Leakage
0V < V
IN
< V
DD
±
10
μ
A
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