參數(shù)資料
型號(hào)： SI5364-F-BC
廠商： Electronic Theatre Controls, Inc.
英文描述： SONET/SDH PRECISION PORT CARD CLOCK IC
中文描述： SONET / SDH的精密端口卡時(shí)鐘IC
文件頁數(shù)： 7/40頁
文件大?。?/td> 565K
代理商： SI5364-F-BC
Si5364
Rev. 2.2
7
Table 2. DC Characteristics
(V
DD33
= 3.3 V ±5%, T
A
= –20 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
Supply Current
Single Clock Output
Four Clock Outputs
Power Dissipation Using 3.3 V Supply
Single Clock Output
Four Clock Outputs
Common Mode Input Voltage
1,2,3
(CLKIN_A, CLKIN_B, REF/CLKIN_F)
Single-Ended Input Voltage
2,3,4
(CLKIN_A, CLKIN_B, REF/CLKIN_F)
Differential Input Voltage Swing
2,3,4
(CLKIN_A, CLKIN_B, REF/CLKIN_F)
Input Impedance
(CLKIN_A+, CLKIN_A-, CLKIN_B+, CLKIN_B–,
REF/CLKIN_F+,
REF/CLKIN_F–)
Differential Output Voltage Swing
(CLKOUT_[3:0])
Output Common Mode Voltage
(CLKOUT_[3:0])
Output Short to GND (CLKOUT_[3:0])
I
DD
f
out
= 19.44 MHz
—
—
120
212
140
240
mA
P
D
f
out
= 19.44 MHz
—
396
700
1.5
462
792
2.0
mW
V
ICM
1.0
V
V
IS
See Figure 1A
200
—
500
4
mV
PP
V
ID
See Figure 1B
200
—
500
4
mV
PP
R
IN
—
80
—
k
V
OD
100
Load
Line-to-Line
100
Load
Line-to-Line
816
906
1100
mV
PP
V
OCM
1.4
1.8
2.2
V
I
SC(–)
–60
—
—
mA
Output Short to V
DD25
(CLKOUT_[3:0])
I
SC(+)
—
–45
—
mA
Input Voltage Low (LVTTL Inputs)
V
IL
—
—
0.8
V
Input Voltage High (LVTTL Inputs)
V
IH
2.0
—
—
V
Input Low Current (LVTTL Inputs)
I
IL
—
—
50
μ
A
Input High Current (LVTTL Inputs)
I
IH
—
—
50
μ
A
Input Impedance (LVTTL Inputs)
R
IN
50
—
—
k
Internal Pulldown (LVTTL inputs)
I
pd
—
—
50
μ
A
FSYNC Output Charge Current
I
OH_FSYNC
V
FSYNC
= 0 V
C
LOAD
= 10 pF
V
FSYNC
= V
DD
C
LOAD
= 10 pF
100
—
—
μ
A
FSYNC Output Discharge Current
I
OL_FSYNC
320
—
—
μ
A
Notes:
1.
The Si5364 device provides weak 1.5 V internal biasing that enables ac-coupled operation.
2.
Clock inputs may be driven differentially or single-endedly. When driven single-endedly, the unused input should be ac-
coupled to ground.
3.
Transmission line termination, when required, must be provided externally.
4.
Although the Si5364 device can operate with input clock swings as high as 1500 mV
PP
, Silicon Laboratories recommends
maintaining the input clock amplitude below 500 mV
PP
for optimal performance.
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