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參數(shù)資料
| 型號： | SH7145 |
| 廠商： | Renesas Technology Corp. |
| 英文描述： | Hitachi SuperH RISC engine |
| 中文描述： | 日立的SuperH RISC引擎 |
| 文件頁數(shù)： | 465/773頁 |
| 文件大?。?/td> | 4187K |
| 代理商： | SH7145 |
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Rev. 2.0, 09/02, page 425 of 732
Bit
Bit
Name
Initial
Value
R/W
Description
1
IRIC
0
R/(W
)*
I
The IRIC flag indicates that the I
generated an interrupt request for the CPU. When the slave
address or the general call address is detected in slave-
reception mode after the transfer of data has been
completed, when there is a failure because of bus conflict in
the master-transmission mode, and when the stop condition
is detected, the IRIC flag is set to 1. The timing with which
the IRIC flag is set changes according to the combination of
the values of the FS bit in SAR and the WAIT bit in ICMR.
Refer to section 14.4.6, Timing for Setting IRIC and the
Control of SCL. In addition, the condition on which the IRIC
flag is set changes according to the setting of the ACKE bit in
ICCR.
The IRIC flag is cleared by reading 1 from IRIC and then
writing 0.
When the DTC is used, the IRIC flag is automatically cleared;
this allows transfer to be continuous and without the
intervention of the CPU.
0: Transfer-wait state or during a transfer
1: An interrupt is generated.
For details, refer to table 14.5, Description of IRIC.
2
C-bus-interface interrupt-request flag
2
C bus interface has
0
SCP
1
W
Start/stop condition issuance disabling bit
This bit controls issuing of the start/stop-condition signals in
master mode. When setting the start condition, write 1 to
BBSY and 0 to SCP. When re-transmitting the start condition,
follow the same procedure. The stop condition is set by
writing 0 to BBSY and SCP. When this bit is read, it always
returns 1. 1 written to this bit will not be stored.
0: In combination with the BBSY flag, issues the start/stop-
condition signals during writing.
1: When read, 1 is always returned. Writing to this bit is not a
valid operation.
Note:
*
It is only possible to write a 0 to this bit, to clear the flag.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SH7145F-ZTAT | Hitachi SuperH RISC engine |
| SH7290E10A | SH7290 E10A Emulator |
| SH7604 | Hardware Manual |
| SH7615 | CMOS single-chip microcontroller |
| SH7706 | Renesas 32-Bit RISC Microcomputer Super RISC engine Family/SH7700 Series |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| SH7145F-ZTAT | 制造商:RENESAS 制造商全稱:Renesas Technology Corp 功能描述:Hitachi SuperH RISC engine |
| SH716A | 制造商:Thomas & Betts 功能描述:HOOD,SIDE ENTRY |
| SH716AMV | 制造商:Thomas & Betts 功能描述:A16 SINGLE LOCK SYS 1XPG21-3/4 |
| SH716-H | 制造商:Thomas & Betts 功能描述:HOOD,SIDE ENTRY |
| SH716HMV | 制造商:Thomas & Betts 功能描述:B16 SINGLE LOCK SYS 1XPG29-1 |
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