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參數(shù)資料
| 型號： | SDA9380-B21 |
| 廠商： | MICRONAS SEMICONDUCTOR HOLDING AG |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | EDDC Enhanced Deflection Controller and RGB Processor |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, PQFP64 |
| 封裝： | PLASTIC, MQFP-64 |
| 文件頁數(shù)： | 29/72頁 |
| 文件大?。?/td> | 366K |
| 代理商： | SDA9380-B21 |
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SDA 9380 - B21
Preliminary Data Sheet
System description
Micronas
5-21
2001-01-29
The
PLL control byte 0
includes the following bits:
-INCR4..0:
Nominal PLL output frequency
INCR=INT((FH*55296)/FQ-64.625)
(for typical values see table below)
specified range:6
≤
INCR
≤21
(FQ=24.576MHz)
Internal default value:
INCR = 6
INCR = 6
INCR = 20
if FH1_2 = High
if FH1_2 = Low, SSD = Low
if FH1_2 = Low, SSD = High
Default value read by IIC bus: INCR = 0
The
PLL control byte 1
includes the following bits:
-GENMOD: Clock generator mode
0: normal PLL mode
1: generator mode (fixed frequency output, controlled by INCR..)
-VCR:
PLL filter optimized for
0: TV mode
1: VCR mode
0
0
X
INCR4
INCR3
INCR2
INCR1
INCR0
Application
PAL (50Hz)
NTSC (60Hz)
PAL (60Hz)
PAL (100Hz)
NTSC (120Hz)
ATV
MUSE
Macintosh
(640*480*67Hz)
SVGA
(800*600*60Hz)
FH[Hz]
15625
15750
18750
31250
31500
32400
33750
INCR
FH1_2
6
Low
6
Low
20
Low
6
High
6
High
8
High
11
High
35000
14
High
38000
21
High
0
0
0
GENMOD
VCR
NOISY
VCR
HSWMI
TC_3RD
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