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參數(shù)資料
| 型號： | SDA525X |
| 廠商： | SIEMENS AG |
| 英文描述： | ICs for Consumer Electronics |
| 中文描述： | 消費電子集成電路 |
| 文件頁數(shù)： | 70/143頁 |
| 文件大小： | 1050K |
| 代理商： | SDA525X |
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SDA 525x
Semiconductor Group
70
1998-04-08
Interrupt Priority Register IP0 and IP1
Corresponding bit-locations in both registers are used to set the interrupt priority level of
an interrupt.
Setting/clearing a bit in the IP-registers establishes its associated interrupt request
priority level. If a low-priority level interrupt is being serviced, a higher-priority level
interrupt will interrupt it. However, an interrupt source cannot interrupt a service program
of the same or higher priority level.
Interrupt Priority Register
Default after reset: 00
H
(MSB)
–
IP0.6
IP0
SFR-Address A9
H
(LSB)
IP0.0
IP0.5
IP0.4
IP0.3
IP0.2
IP0.1
Interrupt Priority Register
Default after reset: 00
H
(MSB)
–
IP1.6
IP1
SFR-Address AA
H
(LSB)
IP1.0
IP1.5
IP1.4
IP1.3
IP1.2
IP1.1
Table 16
IP1.X
0
0
1
1
IP0.X
0
1
0
1
Function
Set priority level 0 (lowest)
Set priority level 1
Set priority level 2
Set priority level 3 (highest)
Table 17
Bit
IP1.0 / IP0.0
IP1.1 / IP0.1
IP1.2 / IP0.2
IP1.3 / IP0.3
IP1.4 / IP0.4
IP1.5 / IP0.5
IP1.6 / IP0.6
Corresponding Interrupt
IE0
TF0
IE1
TF1
RI/TI
DVIRST/ DHIRST/ EVENST/ LIN24ST/AVIRST/AHIRST
IADC
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PDF描述 |
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參數(shù)描述 |
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