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參數(shù)資料
| 型號： | P9S12XEP100J1VAL |
| 廠商： | 飛思卡爾半導(dǎo)體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 360/1036頁 |
| 文件大?。?/td> | 3356K |
| 代理商： | P9S12XEP100J1VAL |
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Chapter 10 XGATE (S12XGATEV3)
MC9S12XE-Family Reference Manual , Rev. 1.07
360
Freescale Semiconductor
10.3.1.1
XGATE Control Register (XGMCTL)
All module level switches and flags are located in the XGATE Module Control Register
Figure 10-3
.
Read: Anytime
Write: Anytime
Module Base +0x00000
15
0
14
0
XG
FRZM
0
13
0
XG
DBGM
0
12
0
XG
SSM
0
11
0
XG
10
0
9
0
8
0
7
6
5
4
3
2
0
1
0
R
W
XGEM
XGE
XGFRZ XGDBG XGSS XGFACT
XG
SWEF
XGIE
FACTM
0
SXG
0
Reset
0
0
0
0
0
0
0
0
0
0
0
= Unimplemented or Reserved
Figure 10-3. XGATE Control Register (XGMCTL)
Table 10-1. XGMCTL Field Descriptions (Sheet 1 of 3)
Field
Description
15
XGEM
XGE Mask
— This bit controls the write access to the XGE bit. The XGE bit can only be set or cleared if a "1" is
written to the XGEM bit in the same register access.
Read:
This bit will always read "0".
Write:
0 Disable write access to the XGE in the same bus cycle
1 Enable write access to the XGE in the same bus cycle
14
XGFRZM
XGFRZ Mask
— This bit controls the write access to the XGFRZ bit. The XGFRZ bit can only be set or cleared
if a "1" is written to the XGFRZM bit in the same register access.
Read:
This bit will always read "0".
Write:
0 Disable write access to the XGFRZ in the same bus cycle
1 Enable write access to the XGFRZ in the same bus cycle
13
XGDBGM
XGDBG Mask
— This bit controls the write access to the XGDBG bit. The XGDBG bit can only be set or cleared
if a "1" is written to the XGDBGM bit in the same register access.
Read:
This bit will always read "0".
Write:
0 Disable write access to the XGDBG in the same bus cycle
1 Enable write access to the XGDBG in the same bus cycle
12
XGSSM
XGSS Mask
— This bit controls the write access to the XGSS bit. The XGSS bit can only be set or cleared if a
"1" is written to the XGSSM bit in the same register access.
Read:
This bit will always read "0".
Write:
0 Disable write access to the XGSS in the same bus cycle
1 Enable write access to the XGSS in the same bus cycle
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