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參數(shù)資料
| 型號： | P9S12XEP100J1VAAR |
| 廠商： | 飛思卡爾半導體(中國)有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 760/1036頁 |
| 文件大?。?/td> | 3356K |
| 代理商： | P9S12XEP100J1VAAR |
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Chapter 19 Serial Communication Interface (S12SCIV5)
MC9S12XE-Family Reference Manual , Rev. 1.07
760
Freescale Semiconductor
In
Figure 19-24
, a large burst of noise is perceived as the beginning of a start bit, although the test sample
atRT5ishigh.TheRT5samplesetsthenoiseflag.Althoughthisisaworst-casemisalignmentofperceived
bit time, the data samples RT8, RT9, and RT10 are within the bit time and data recovery is successful.
Figure 19-24. Start Bit Search Example 3
Figure 19-25
showsthe effect of noiseearly in the startbit time.Although thisnoise does notaffect proper
synchronization with the start bit time, it does set the noise flag.
Figure 19-25. Start Bit Search Example 4
Reset RT Clock
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
Samples
RT Clock
RT Clock Count
Actual Start Bit
RXD
1
0
1
1
1
0
0
0
0
LSB
0
Perceived Start Bit
Reset RT Clock
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
R
Samples
RT Clock
RT Clock Count
Perceived and Actual Start Bit
RXD
1
1
1
1
1
0
0
1
LSB
1
1
1
1
相關PDF資料 |
PDF描述 |
|---|---|
| P9S12XEP100J1VAG | Microcontrollers |
| P9S12XEP100J1VAGR | Microcontrollers |
| P9S12XEP100J1VAL | Microcontrollers |
| P9S12XEP100J1VALR | Microcontrollers |
| P9S12XEP100J1VVL | Microcontrollers |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| P9S12XEP100J1VAG | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P9S12XEP100J1VAGR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P9S12XEP100J1VAL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P9S12XEP100J1VALR | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| P9S12XEP100J1VVL | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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