參數(shù)資料
型號(hào)： MT90820
廠商： Zarlink Semiconductor Inc.
英文描述： Large Digital Switch
中文描述： 大型數(shù)字開(kāi)關(guān)
文件頁(yè)數(shù)： 16/37頁(yè)
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代理商： MT90820
MT90820
Data Sheet
16
Zarlink Semiconductor Inc.
Table 10 - Frame Alignment (FAR) Register Bits
Figure 3 - Example for Frame Alignment Measurement
10 - 0
FD10-0
Frame Delay Bits.
The binary value expressed in these bits refers to the measured
input offset value. These bits are reset to zero when the SFE bit of the IMS register
changes from 1 to 0. (FD10 = MSB, FD0 = LSB)
Bit
Name
Description
Read Address:
Reset Value:
02
H
,
0000
H
.
7
6
5
4
3
2
1
0
8
9
10
11
12
13
FD0
FD1
FD2
FD3
FD4
FD5
FD6
FD7
FD8
FD9
FD10
FD11
CFE
0
0
0
14
15
ST-BUS Frame
FE Input
GCI Frame
FE Input
(FD11 = 0, sample at CLK low phase)
(FD11 = 1, sample at CLK high phase)
(FD[10:0] = 09
H
)
Offset Value
(FD[10:0] = 06
H
)
1
0
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
Offset Value
1
0
2
3
4
5
6
7
8
9
10
11
12
13
14
15
CLK
CLK
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