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參數(shù)資料
| 型號： | MT9072AV |
| 廠商： | ZARLINK SEMICONDUCTOR INC |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PBGA220 |
| 封裝： | 17 X 17 MM, 1.30 MM HEIGHT, MO-192, LBGA-220 |
| 文件頁數(shù)： | 93/275頁 |
| 文件大?。?/td> | 3738K |
| 代理商： | MT9072AV |
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MT9072
Data Sheet
93
Zarlink Semiconductor Inc.
14.2 E1 Maintenance and Alarms
Extensive maintenance and alarm generation and detection functions are provided on the MT9072. The following
table groups the registers for control and monitor of these functions.
14.2.1 E1 Error Insertion
Six types of error conditions can be inserted into the transmit PCM30 data stream through register control bits
located at address Y01. These error events include the bipolar violation errors (BVE), CRC-4 errors (CRCE), FAS
errors (FASE), NFAS errors (NFSE), payload (PERR) and a loss of signal error (LOSE). The LOSE function
overrides the HDB3 encoding function (no BPV are added). Also included are E1 and E2 error bit insertion on
frames 13 and 15. See the bit descriptions (control register address Y01) for additional details.
14.2.2 E1 Per Timeslot Control
There are 32 per timeslot control registers occupying a total of 32 unique addresses (Y90-YAF). Each register
controls a matching timeslot on the 32 transmit channels (onto the line) and the equivalent channel data on the
receive (DSTo) data. For example, register address Y91 of the first per timeslot control register contains program
control for transmit timeslot 1 and DSTo channel 1.
14.2.3 E1 Per Timeslot Looping
Any channel or combination of channels may be looped from transmit (sourced from DSTi) to receive (output on
DSTo) ST-BUS channels. When bit 4 (LTSL) in the Per Timeslot Control Word is set the data from the equivalent
transmit timeslot is looped back onto the equivalent receive channel.
Any channel or combination of channels may be looped from receive (sourced from the line data) to transmit
(output onto the line) channels. When bit 5 (RTSL) in the Per Timeslot Control Word is set the data from the
equivalent receive timeslot is looped back onto the equivalent transmit channel.
Register
Address
Register
Description
Y00
Alarm and Framing Control Register The TAIS and E bit errors and RAI can be set by this register.
Y01
Test Error and Loopback Control
Register
BPVE, CRCE,FASE, NFSE and E bit errors can be inserted.
Y05
CAS Control and Data Register
The Y bit can be used to send Remote Multiframe Alarm signal.
Y10
Synchronization and CRC-4
Remote Status
The bits of this register provide good receiver error status.
Y11
CRC-4 Timer and CRC-4 Local
Status
The CRC-4 errors are registered in Y11.
Y12
Alarms and MAS Status
This register provides AIS, RAI, LOSS status bits.
Y24
Sync, CRC-4 remote alarm, MAS
Latched Status Register
Latched version of receive CRC errors and synchronization loss
are available.
Y34
Sync, CRC-4 Remote Alarm, MAS
Interrupt status register
This register provides bits for interrupt generation for Y24 CRC
errors and synchronization loss functions.
Y44
Sync, CRC-4 Remote Alarm, MAS
Interrupt register mask
This register provides bits for interrupt mask register for Y34.
Table 47 - Registers Related to Maintenance and Alarms (E1)
相關PDF資料 |
PDF描述 |
|---|---|
| MT90820 | Large Digital Switch |
| MT90820AL | Large Digital Switch |
| MT90820AL1 | Large Digital Switch |
| MT90823AL1 | 3V Large Digital Switch |
| MT90823 | 3V Large Digital Switch |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MT9072AV2 | 制造商:Microsemi Corporation 功能描述:FRAMER E1/J1/T1 3.3V 220BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 220BGA - Trays |
| MT90732 | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F) |
| MT90732AP | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F) |
| MT90733 | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS DS3 Framer (DS3F) |
| MT90733AP | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS DS3 Framer (DS3F) |
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