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參數(shù)資料
| 型號： | MT9072 |
| 廠商： | Zarlink Semiconductor Inc. |
| 元件分類： | 通信及網(wǎng)絡(luò) |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 文件頁數(shù)： | 67/275頁 |
| 文件大?。?/td> | 3738K |
| 代理商： | MT9072 |
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MT9072
Data Sheet
67
Zarlink Semiconductor Inc.
8.2.2 E1 Channel Associated Signaling (CAS) Register and ST-BUS Access
The CSIG control bit (register address Y03) must be set to zero for Channel Associated signaling (CAS) operation.
Access to the ABCD transmit and receive bits may be either through ST-BUS channels 1 to 15 and channels 17 to
31 at the CSTi and CSTo pins, or through the Transmit CAS Data registers (Y51-Y6F) and Receive CAS Data
registers (Y71-Y8F) accessed by the parallel processor port, or through a mix of both methods. The timeslot control
register bits (CASS(n) address Y90-YAF) determine the source of the CAS data on a per channel basis. A zero
enables an ST-BUS source and a one enables a register source. Note that when changing the CASS(n) control bits
from ST-BUS source to register source on the fly (during normal operation as opposed to during power up), the
data in the Transmit CAS Data registers (Y51-Y6F) should be updated one frame after the timeslot control register
bits (CASS(n)) are changed. This is because the timeslot control register bits do not take effect immediately. Both
destinations of CAS data are always enabled (i.e., ST-BUS CSTo and receive data registers). ST-BUS CSTi and
CSTo channels 0 and 16 are not used.
When the CASRI interrupt is unmasked, IRQ will become active when a signaling state change is detected in any of
the 30 receive channels and a selectable 2 msec, 8 msec or 16 msec timer(Y04 bit 0,1) has expired. This function
helps to reduce the frequency of interrupts generated due to signaling changes. For instance if 7 channels had a
signaling change only one interrupt will be generated in a 2, 8 or 16 msec duration. Upon an interrupt the user has
to read the CAS registers (Y70 to Y8F) to determine the channels with a signaling change.The CASRIM interrupt
CAS
Frame
PCM30 Timeslot 16
1
2
3
4
5
6
7
8
Channel
Associated
signaling
(CAS)
Multiframe
(not related
to CRC-4
multiframing)
MAS - Multiframe Alignment Signal
NMAS - Non-multiframe Alignment Signal
X - Spare Bit = 1 if not used
Y - Remote Multiframe Alarm Signal
0
0000 (MAS)
XYXX (NMAS)
1
ABCD (ch 1 = ts1)
ABCD (ch 16 = ts 17)
2
ABCD (ch 2 = ts 2)
ABCD (ch 17 = ts 18)
3
ABCD (ch 3 = ts 3)
ABCD (ch 18 = ts 19)
4
ABCD (ch 4 = ts 4)
ABCD (ch 19 = ts 20)
5
ABCD (ch 5 = ts 5)
ABCD (ch 20 = ts 21)
6
ABCD (ch 6 = ts 6)
ABCD (ch 21 = ts 22)
7
ABCD (ch 7 = ts 7)
ABCD (ch 22 = ts 23)
8
ABCD (ch 8 = ts 8)
ABCD (ch 23 = ts 24)
9
ABCD (ch 9 = ts 9)
ABCD (ch 24 = ts 25)
10
ABCD (ch 10 = ts 10)
ABCD (ch 25 = ts 26)
11
ABCD (ch 11 = ts 11)
ABCD (ch 26 = ts 27)
12
ABCD (ch 12 = ts 12)
ABCD (ch 27 = ts 28)
13
ABCD (ch 13 = ts 13)
ABCD (ch 28 = ts 29)
14
ABCD (ch 14 = ts 14)
ABCD (ch 29 = ts 30)
15
ABCD (ch 15 = ts 15)
ABCD (ch 30 = ts 31)
Table 24 - Channel Associated Signaling (CAS) Multiframe Structure (E1)
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MT9072AB | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT9072AV | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| MT90820 | Large Digital Switch |
| MT90820AL | Large Digital Switch |
| MT90820AL1 | Large Digital Switch |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MT9072AB | 制造商:ZARLINK 制造商全稱:Zarlink Semiconductor Inc 功能描述:Octal T1/E1/J1 Framer |
| MT9072AV | 制造商:Microsemi Corporation 功能描述:FRAMER E1/J1/T1 3.3V 256BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 256BGA - Trays |
| MT9072AV2 | 制造商:Microsemi Corporation 功能描述:FRAMER E1/J1/T1 3.3V 220BGA - Trays 制造商:Zarlink Semiconductor Inc 功能描述:FRAMER E1/J1/T1 3.3V 220BGA - Trays |
| MT90732 | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F) |
| MT90732AP | 制造商:MITEL 制造商全稱:Mitel Networks Corporation 功能描述:CMOS E2/E3 Framer (E2/E3F) |
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